本发明涉及一种用于闪存存储器系统中的低功率操作的电路和方法。在选择解码电路路径的所公开实施方案中，在省电或关闭模式期间使用上拉电路和下拉电路在某些输出节点处保存值，从而允许主电源关闭，同时仍然保持所述值。同时仍然保持所述值。同时仍然保持...

本发明涉及一种闪存存储器系统，其中一个或多个电路区块利用全耗尽型绝缘体上硅晶体管设计来使泄漏最小化。管设计来使泄漏最小化。管设计来使泄漏最小化。

本发明公开了一种包括第一导电类型的半导体衬底的非易失性存储器装置。非易失性存储器单元阵列位于所述半导体衬底中并按多个行和列布置。每个存储器单元包括位于所述半导体衬底的表面上的第二导电类型的第一区，以及位于所述半导体衬底的所述表面上的所述...

本发明公开了一种包括第一导电类型的半导体衬底的非易失性存储器装置。非易失性存储器单元阵列位于所述半导体衬底中并按多个行和列布置。每个存储器单元包括位于所述半导体衬底的表面上的第二导电类型的第一区，以及位于所述半导体衬底的所述表面上的所述...

本发明涉及用于读取阵列中的闪存单元的值的改进读出放大器。在一个实施例中，读出放大器包括改进的预充电电路，以用于在预充电周期期间对位线进行预充电，从而提高读操作的速度。在另一个实施例中，读出放大器包括简化的地址解码电路，以提高读操作的速度。

公开了用于经由具有差分阈值电压的MOS晶体管的使用来提供选择性阈值电压特性的系统和方法。在一个示例性实施例中，提供了一种金属氧化物半导体器件，其包括具有源极区、漏极区和在其之间的沟道区、在所述沟道区之上的绝缘层，以及所述绝缘层的栅极部分...

本公开涉及形成分裂栅存储器单元的方法。本发明公开了一种形成存储器设备的方法，包括在第一导电层上形成第二绝缘层，该第一导电层形成在第一绝缘层上，该第一绝缘层形成在半导体基板上。在第二绝缘层中形成向下延伸到第一导电层的一部分并且暴露该第一导...

本发明题为“形成具有间隔物限定的浮栅和离散地形成的多晶硅栅的分裂栅闪存存储器单元的方法”。本发明公开了一种形成存储器设备的方法，所述方法包括使用第一多晶硅沉积在半导体衬底上方形成第一多晶硅层，在所述第一多晶硅层上形成绝缘间隔物，以及移除...

用于减少闪存存储器系统中字线和控制栅极线之间的耦合的方法和装置。本发明公开了一种方法和装置，以用于减少由于寄生电容和寄生电阻而导致闪存存储器系统中的字线和控制栅极线之间原本可能出现的耦合。所述闪存存储器系统包括被组织成行和列的闪存存储器...

用于闪存存储器系统的改进的感测放大器。本发明公开了在闪存存储器系统中使用的改进的低功率感测放大器。基准位线和选择的位线在有限周期期间被预充电并且消耗的功率有限。预充电电路可在配置过程期间进行修调，以进一步优化预充电操作期间的功率消耗。

本发明公开了一种形成具有在平面衬底表面上方的存储器单元和在鳍形衬底表面部分上方的FinFET逻辑器件的存储器器件的方法，所述方法包括在所述衬底的存储器单元部分中的先前形成的浮栅、擦除栅、字线多晶硅和源极区上方形成保护层，接着在所述衬底的...

本发明题为“在专用沟槽中具有浮栅的非易失性存储器单元”。本发明提供了一对存储器单元，所述存储器单元包括：形成于半导体衬底的上表面中的间隔开的第一沟槽和第二沟槽，以及设置在所述第一沟槽和所述第二沟槽中的第一浮栅和第二浮栅。第一字线栅和第二...

本发明公开了双位存储器单元，所述双位存储器单元包括在半导体衬底的所述上表面的第一沟槽和第二沟槽中形成的间隔开的第一浮栅和第二浮栅。擦除栅或一对擦除栅分别设置在所述浮栅上方并且与所述浮栅绝缘。字线栅设置在介于所述第一沟槽和所述第二沟槽之间...

本发明公开了用于嵌入式闪存装置内的改进的通电次序的系统和方法。

存储器设备包括：金属氧化物材料，该金属氧化物材料被设置在第一导电电极和第二导电电极之间并且与它们电接触；和电流源，该电流源被配置成施加通过金属氧化物材料的一个或多个电流脉冲。对于所述一个或多个电流脉冲中的每一个，所述电流的振幅在所述电流...

本发明公开了一种提供单独的存储器单元读取、写入和擦除的存储器设备。在以行和列布置的存储器单元的阵列中，每列存储器单元包括列位线、用于偶数行单元的第一列控制栅极线和用于奇数行单元的第二列控制栅极线。每行存储器单元包括行源极线。在另一个实施...

本发明公开了用于存储器装置的混合电荷泵和控制电路。

本发明公开了一种存储器设备和擦除该存储器设备的方法，该存储器设备包括半导体材料衬底，和形成在衬底上并布置成行和列的阵列的多个存储器单元。存储器单元中的每一个储器单元包括在衬底中间隔开的源极区和漏极区，其中衬底中的沟道区在源极区和漏极区之...

本发明涉及用于闪存存储器装置中的读取操作的改进的感测放大器及相关方法。在一个实施方案中，所述感测放大器包括内置电压偏移。在另一个实施方案中，通过使用电容器在所述感测放大器中感生电压偏移。在另一个实施方案中，所述感测放大器为参考信号使用具...

本发明涉及具有闪存存储器单元和解码器电路，该闪存存储器单元具有仅四个端子，该解码器电路用于操作此类闪存存储器单元的阵列。与现有技术相比，本发明允许每个闪存存储器单元的端子更少，这导致所述解码器电路和每个闪存存储器单元所需的总体管芯空间的...