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本发明公开了一种基于可逆逻辑的4位阵列乘法器，该乘法器由一个基于可逆逻辑的部分积产生模块与三个基于可逆逻辑的4位进位跳跃加法器分层级联而成，所述乘法器输入端口输入两组4位二进制数，经过所述部分积产生模块计算并输出16个部分积P30-P00、...
该专利属于重庆邮电大学所有，仅供学习研究参考，未经过重庆邮电大学授权不得商用。

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