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公开一种增量式提高FPGA时序性能的方法及装置，本发明首先调用时序分析获取时间裕度最小的连接集合C，然后对连接集合C中的每条连接c，首先执行增量装箱将c起点的BLE移动到c终点BLE所在的CLB，再增量装箱将c终点的BLE移动到c起点BLE...
该专利属于中科亿海微电子科技（苏州）有限公司所有，仅供学习研究参考，未经过中科亿海微电子科技（苏州）有限公司授权不得商用。

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