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本发明涉及一种基于高速数据交换的强实时性双机同步容错系统，其中，包括：A机处理单元、B机处理单元、仲裁单元和对外接口；A机主处理器模块和B机主处理器模块分别给仲裁单元发送工作状态请求信号，ARM处理器将先收到请求信号的A机或B机处理单元设置...
该专利属于北京计算机技术及应用研究所所有，仅供学习研究参考，未经过北京计算机技术及应用研究所授权不得商用。

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