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本发明公开了一种跨时钟域的AHB总线桥接方法和装置，包括：主控制逻辑模块，根据主器件的总线信号生成主时钟域的总线控制信号；根据在主时钟域下采样的被从时钟域锁存的从器件总线信号，产生反馈到主器件的响应信号；从控制逻辑模块，根据从器件的响应信号...该专利属于大唐微电子技术有限公司;大唐半导体设计有限公司所有，仅供学习研究参考，未经过大唐微电子技术有限公司;大唐半导体设计有限公司授权不得商用。