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本发明涉及一种基于FPGA可重构的OFDM信噪比增强系统，包括发射端和接收端，发射端包括时钟生成模块、长短序列生成模块、快速傅里叶逆变换模块和循环前缀与峰值加窗处理模块；时钟生成模块用于生成时钟信号；长短序列生成模块用于形成长训练序列和短训...
该专利属于东华大学所有，仅供学习研究参考，未经过东华大学授权不得商用。

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