System.ArgumentOutOfRangeException: 索引和长度必须引用该字符串内的位置。 参数名: length 在 System.String.Substring(Int32 startIndex, Int32 length) 在 zhuanliShow.Bind() 减少混合和数字PLL中的DCO频率重叠引起的极限循环制造技术_技高网

减少混合和数字PLL中的DCO频率重叠引起的极限循环制造技术

技术编号:44694545 阅读:10 留言:0更新日期:2025-03-19 20:43
一种方法包括:观察到数字控制振荡器(DCO)频率处于DCO频率重叠区域的边界处;以及绕过该DCO频率重叠区域的至少一部分。

【技术实现步骤摘要】
【国外来华专利技术】

一个或多个示例总体上涉及用于将输出时钟跟踪到参考时钟的时钟跟踪电路。一个或多个示例涉及减少时钟跟踪电路的数字控制振荡器中的频率冗余的不良效应。


技术介绍

1、诸如锁相环路和延迟锁定环路之类的时钟跟踪电路是被利用于跟踪时钟和其他振荡信号的电路。时钟跟踪电路的输出信号被锁定到参考信号的相位和频率。在多种操作上下文(包括当具有已知关系的两个信号被利用于发送信息)中利用时钟跟踪电路。


技术实现思路

【技术保护点】

1.一种装置,所述装置包括:

2.根据权利要求1所述的装置,其中为了设置存储在所述数字积分器的所述寄存器处的所述数字相位误差信号的所述积分值,所述逻辑电路用于:

3.根据权利要求2所述的装置,其中为了调整所述数字积分器的所述增益,所述逻辑电路用于:

4.根据权利要求3所述的装置,其中所述参数包括:累积步长、累积时间或缩放因子。

5.根据权利要求1所述的装置,其中所述逻辑电路包括:

6.根据权利要求5所述的装置,其中用于设置所述积分值的所述逻辑电路至少部分地基于相应的调整值。

7.根据权利要求1所述的装置,其中所述数字积分器包括计数器,所述计数器用于递增和递减计数,并且其中所述逻辑电路包括阈值检测器,所述阈值检测器用于至少部分地响应于所述计数和阈值来将所述计数器设置为预先确定的值。

8.根据权利要求1所述的装置,其中所述逻辑电路包括:检测器,所述检测器用于响应于计数和阈值来设置选择信号;和多路复用器,所述多路复用器用于接收步长信号并响应于所述选择信号来输出选定的步长信号,并且其中所述数字积分器包括计数器,所述计数器用于按对应于所述选定的步长信号的量递增或递减所述计数。

9.一种方法,所述方法包括:

10.根据权利要求9所述的方法,其中观察到所述DCO频率处于所述DCO频率重叠区域的所述边界处包括:

11.根据权利要求10所述的方法,所述方法包括:

12.根据权利要求10所述的方法,所述方法包括:

13.根据权利要求10所述的方法,所述方法包括:

14.根据权利要求9所述的方法,其中绕过所述DCO频率重叠区域的至少一部分包括:

15.根据权利要求9所述的方法,所述方法包括:

16.根据权利要求9所述的方法,所述方法包括:

17.一种装置,所述装置包括:

18.根据权利要求17所述的装置,所述装置包括:

19.根据权利要求18所述的装置,其中所述控制器设置所述控制代码的所述值以绕过所述DCO的DCO频率重叠区域。

20.根据权利要求17所述的装置,其中所述控制器设置所述控制代码的绕过值,所述绕过值对应于DCO频率重叠区域内的DCO频率。

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【技术特征摘要】
【国外来华专利技术】

1.一种装置,所述装置包括:

2.根据权利要求1所述的装置,其中为了设置存储在所述数字积分器的所述寄存器处的所述数字相位误差信号的所述积分值,所述逻辑电路用于:

3.根据权利要求2所述的装置,其中为了调整所述数字积分器的所述增益,所述逻辑电路用于:

4.根据权利要求3所述的装置,其中所述参数包括:累积步长、累积时间或缩放因子。

5.根据权利要求1所述的装置,其中所述逻辑电路包括:

6.根据权利要求5所述的装置,其中用于设置所述积分值的所述逻辑电路至少部分地基于相应的调整值。

7.根据权利要求1所述的装置,其中所述数字积分器包括计数器,所述计数器用于递增和递减计数,并且其中所述逻辑电路包括阈值检测器,所述阈值检测器用于至少部分地响应于所述计数和阈值来将所述计数器设置为预先确定的值。

8.根据权利要求1所述的装置,其中所述逻辑电路包括:检测器,所述检测器用于响应于计数和阈值来设置选择信号;和多路复用器,所述多路复用器用于接收步长信号并响应于所述选择信号来输出选定的步长信号,并且其中所述数字积分器包括计...

【专利技术属性】
技术研发人员:Y·福扎尔W·埃尔哈尔瓦吉W·罗伯茨K·克松泽F·瓦萨利
申请(专利权)人:微芯片技术股份有限公司
类型:发明
国别省市:

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