【技术实现步骤摘要】
本专利技术属于集成电路，具体涉及一种无毛刺的延迟链切换电路及切换方法。
技术介绍
1、现有主流延迟链设计为被延迟信号进入若干个延迟单元串联的延迟链路，会通过选择器输出的选择信号选择不同数量的延迟单元，或者通过开关延迟单元的使能选通不同数量的延迟单元，进而实现延迟时长的切换。
2、但是当前主流的延迟链设计在延迟时间切换时，可能会重新对延迟链进行建立，这会导致延迟信号的输出产生毛刺，进而对传输系统造成风险。
3、因此，为了保证输出的延迟信号不会产生毛刺，在主流设计中，一般在变换延迟时间时都要求延迟链无信号输入，需要等到延迟控制码(即切换指令)稳定后才能继续传输信号，对设计应用有较大限制。
技术实现思路
1、本专利技术提供一种无毛刺的延迟链切换电路及切换方法，用以解决现有技术中延迟链电路在切换延迟时间时，无法在保持延迟电路持续输入信号的同时使得延迟链电路输出的信号无毛刺的问题。
2、为了解决上述技术问题，第一方面，本专利技术提供一种无毛刺的延迟链切换电路，该延迟链电路包括：
3、延迟链单元，用于接收目标信号，并对目标信号延迟第一延迟时间后输出第一延迟信号，对所述目标信号延迟第二延迟时间后输出第二延迟信号，其中，所述第一延迟时间与所述第二延迟时间不相同；
4、延时切换单元，与所述延迟链单元相连接，用于接收延时切换指令，并在接收到所述延时切换指令时输出切换信号，以切换所述第一延迟时间的时长和/或所述第二延迟时间的时长，其中，所述第一
5、触发单元，与所述延迟链单元相连接，用于接收所述第一延迟信号和所述第二延迟信号，并在所述第一延迟信号和所述第二延迟信号由不同变为相同时输出触发信号；
6、第一触发器单元，分别与所述触发单元和所述延迟链单元相连接，用于接收所述触发信号和所述第一延迟信号，并在接收到所述触发信号时将所述第一延迟信号输出。
7、可选地，所述触发单元包括同或门，所述同或门的输入端口与所述延迟链单元相连接，以分别输入所述第一延迟信号和所述第二延迟信号，所述同或门的输出端口与所述第一触发器单元相连接。
8、可选地，所述第一触发器单元包括d触发器，所述d触发器的时钟端口与所述同或门的输出端口相连接，所述d触发器的数据输入端口与所述延迟链单元相连接，以接收所述延迟链单元输出的第一延迟信号。
9、可选地，所述延迟链单元包括：
10、第一延迟链，分别与所述触发单元和所述第一触发器单元相连接，所述第一延迟链包括第一延时子单元，用于接收所述目标信号，并对所述目标信号延迟第一延迟时间后输出第一延迟信号；
11、第二延迟链，与所述触发单元相连接，所述第二延迟链包括第二延时子单元，用于接收所述目标信号，并对所述目标信号延迟第二延迟时间后输出第二延迟信号，其中，所述第二延时子单元的第二数量与所述第一延时子单元的第一数量不同。
12、可选地，无毛刺的延迟链切换电路还包括第二触发器单元，所述第二触发器单元的数据输入端口与所述第二延迟链的输出端口相连接。
13、可选地，所述第一数量和所述第二数量具有如下公式所示的数量关系：
14、nx＝v1，nx+(n/2)＝v2；
15、其中，n为第一预设值，且n为偶数，x为第二预设值，且x为正整数，v1为所述第一数量的值，v2为所述第二数量的值。
16、第二方面，本专利技术提供一种无毛刺的延迟链切换方法，该延迟链切换方法包括：
17、将目标信号输入延迟链单元，通过所述延迟链单元对所述目标信号延迟第一延迟时间得到第一延迟信号；
18、将所述目标信号输入所述延迟链单元，通过所述延迟链单元对所述目标信号延迟第二延迟时间得到第二延迟信号；
19、对所述第一延迟时间和/或所述第二延迟时间的值进行切换，输出切换后的第一延迟信号和/或第二延迟信号，其中，所述第一延迟时间和所述第二延迟时间的时间差值在切换后保持不变；
20、在切换后的所述第一延迟信号和所述第二延迟信号由不同变为相同时，将所述第一延迟信号通过第一触发器单元输出。
21、可选地，所述对所述第一延迟时间和/或所述第二延迟时间的值进行切换，包括：
22、控制所述延迟链单元中第一延时子单元的选通数量，以切换不同的所述第一延迟时间；
23、控制所述延迟链单元中第二延时子单元的选通数量，以切换不同的所述第二延迟时间。
24、可选地，所述对所述第一延迟时间和/或所述第二延迟时间的值进行切换，包括：
25、通过温度计码的任一位控制预设数量的延时子单元的选通，其中，所述延时子单元为所述第一延时子单元或者所述第二延时子单元，且所述温度计码的偶数位用于控制所述第一延时子单元，所述温度计码的奇数位用于控制所述第二延时子单元；
26、保持第三数量的第二延时子单元始终为选通状态，其中，所述第三数量为所述预设数量的一半，且所述预设数量为偶数；
27、切换所述温度计码的位数，以切换所述第一延迟时间和/或所述第二延迟时间。
28、可选地，所述温度计码的位数的切换范围为(1，+∞)。
29、与现有技术相比，本专利技术提供的一种无毛刺的延迟链切换电路，具有以下
30、有益效果：
31、在第一延迟信号或第二延迟信号延时切换产生毛刺(即由目标信号突变为相反的原始信号)时，若第一触发器单元输出端口输出的信号会随之产生毛刺(即信号发生突变)，则需要满足两个条件，第一个条件为延时切换时触发单元能够输出触发信号(即第一延迟信号和第二延迟信号由不同变为相同)，第二个条件为第一触发器单元在延时切换时刻的输出信号与第一延迟信号相反；
32、而在第一个条件中需要满足在延时切换之前第一延迟信号与第二延迟信号不同，显然这会导致在延时切换之前触发单元不会产生触发信号，所以在延时切换之前第一触发器单元的输出保持原始信号不变，而第一延迟信号在延时切换时刻产生毛刺，会使得第一延迟信号在延时切换时刻之后突变回原始信号，因此在满足第一个条件时，第一触发器单元在延时切换时刻的输出信号无法与第一延迟信号相反，所以第一个条件和第二个条件显然无法同时存在，自然也不会在第一触发器单元的输出端口产生毛刺；
33、另外，由于在延时切换之前或者之后第一延迟信号和第二延迟信号均具有延时时差，因此可以在第一延迟信号和第二延迟信号的延时时差阶段产生触发信号，触发第一触发器单元输出第一延迟信号，从而达到输出无毛刺的延迟信号的效果，并且在本专利技术的方案中，并没有在产生毛刺时停止输入目标信号，从而可以一直保持向延迟电路中输入信号。综上所述，本专利技术能够解决现有技术中，延迟链电路在切换延迟时间时，无法在保持延迟电路持续输入信号的同时，使得延迟链电路输出的信号无毛刺的问题。
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1.一种无毛刺的延迟链切换电路，其特征在于，包括：
2.根据权利要求1所述的无毛刺的延迟链切换电路，其特征在于，所述触发单元包括同或门，所述同或门的输入端口与所述延迟链单元相连接，以分别输入所述第一延迟信号和所述第二延迟信号，所述同或门的输出端口与所述第一触发器单元相连接。
3.根据权利要求2所述的无毛刺的延迟链切换电路，其特征在于，所述第一触发器单元包括D触发器，所述D触发器的时钟端口与所述同或门的输出端口相连接，所述D触发器的数据输入端口与所述延迟链单元相连接，以接收所述延迟链单元输出的第一延迟信号。
4.根据权利要求1所述的无毛刺的延迟链切换电路，其特征在于，所述延迟链单元包括：
5.根据权利要求4所述的无毛刺的延迟链切换电路，其特征在于，还包括第二触发器单元，所述第二触发器单元的数据输入端口与所述第二延迟链的输出端口相连接。
6.根据权利要求4所述的无毛刺的延迟链切换电路，其特征在于，所述第一数量和所述第二数量具有如下公式所示的数量关系：
7.一种无毛刺的延迟链切换方法，其特征在于，包括：
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