【技术实现步骤摘要】
本专利技术属于集成电路开发，具体涉及集成电路开发系统、集成电路开发方法以及集成电路。
技术介绍
1、信息技术是国民经济的核心技术，其服务于国民经济各个领域，信息技术的关键是微电子技术。集成电路和软件是信息社会经济发展的基石和核心。中国集成电路产业已经形成了ic设计、制造、封装测试三业及支撑配套业共同发展的较为完善的产业链格局。集成电路设计是指根据电路功能和性能的要求，在正确选择系统配置、电路形式、器件结构、工艺方案和设计规则的情况下，尽量减小芯片面积，降低设计成本，缩短设计周期，以保证全局优化，设计出满足要求的基础电路。
2、现有技术中的设计流程对工程师的经验依赖性非常大，设计中工程师必须全程参与，开发成本非常高，开发周期冗长。在集成电路(ic)商业化之前，通常会进行多次修正。修正可能包含添加、删除或更正ic硬件的某些功能。在此过程中，软件开发人员必须配合硬件的变化。因此，有必要提出集成电路开发系统、集成电路开发方法以及集成电路，以至少部分地解决现有技术中存在的问题。
3、本
技术介绍
所公开的上述信息仅仅用于增加对本专利技术
技术介绍
的理解，因此，其可能包括不构成本领域普通技术人员已知的现有技术。
技术实现思路
1、本专利技术的目的在于提供集成电路开发系统、集成电路开发方法以及集成电路，以解决上述
技术介绍
中提出的问题。
2、为实现上述目的，本专利技术提供如下技术方案：
3、集成电路开发系统，包括：逻辑设计模块、布局设计模块、布线设计模块、
4、优选的，所述逻辑设计模块根据集成电路的需求分析来确定能够实现电路的设计逻辑，所述逻辑设计模块通过design compiler将逻辑设计转换为门级网表，以便后续的布局布线过程，所述逻辑设计模块通过逻辑综合算法实现逻辑功能的最小化和优化，以满足电路的性能和功耗要求。
5、优选的，所述逻辑设计模块包括逻辑门库、寄存器传输级描述、组合逻辑等，可以使用这些结构来描述电路的逻辑功能，所述逻辑设计会生成多个可行的电路回路逻辑，在设计布局前评估每个电路回路逻辑的布局难易程度，将较难布局的电路回路逻辑作为后备方案以作后续选用。
6、优选的，所述布局设计模块根据电路设计逻辑和布局规则确定放置逻辑元件、连线和引脚的位置，所述布线设计模块根据电路设计布局和布线规则将布局设计转换为实际的连线布线，以满足电路的时序和功耗要求。
7、优选的，所述时序优化模块通过primetime对设计进行时序分析，找出关键路径和时序问题，并根据分析结果进行优化，提高电路的工作频率和效率，所述功耗分析模块通过powerartist对设计电路进行功耗分析、功耗优化和功耗验证，以降低电路的最大耗能和工作功耗。
8、优选的，所述该开发系统支持多线程任务分配模式，将设计优化问题交由多人协同开发，相互共享设计资源和信息，以加快对多个电路回路的设计优化过程，实现设计的并行开发，为后续的仿真测试做准备。
9、优选的，所述仿真模块通过物理验证方式来验证电路的物理布局是否满足设计要求，同时通过仿真工具的仿真测试过程对电路设计功能进行验证，所述制造验证模块通过工艺设计、版图设计和drc/lvs检查来为芯片的制造做准备，然后通过掩膜制作、晶圆加工、封装测试将设计电路转化为实际的芯片产品。
10、集成电路开发方法，包括：
11、需求分析：明确集成电路的功能需求和性能指标，并确定设计的基本目标；
12、逻辑结构：根据基本目标设计电路的逻辑功能，利用综合工具优化电路结构；
13、布局布线：根据约束条件确定电路中各种元件的位置和大小，形成实际的连线布线；
14、时序功耗：结合时序分析工具优化电路的时序性能，分析电路的功耗特性并进行功耗优化；
15、仿真验证：使用仿真软件对电路功能进行仿真验证，同时验证电路的物理布局是否满足设计要求；
16、后端制造：通过制造工艺将设计的芯片制造出来，并对芯片进行性能测试，准备投入市场应用。
17、优选的，所述在逻辑结构中，使用逻辑门、寄存器传输级描述来描述电路的逻辑功能，综合处理将逻辑功能转换为门级网表并可以用于后续的布局布线，所述在时序功耗中，解决时序约束冲突并评估电路的功耗水平，进而提高电路的工作稳定性，延长电池寿命，所述在布局布线中，需要考虑电路的布局规则和时序约束，保证信号传输的稳定性和准确性。
18、集成电路，包括：
19、存储器，用以存储计算机程序代码，其中该计算机程序代码包含：
20、第一部分，由该基础电路执行，用以产生第一执行结果；以及
21、第二部分，由可编程电路执行，该可编程电路藕接至该集成电路以产生第二执行结果，其中由该基础电路依据该第一执行结果以及该第二执行结果产生模拟结果，以验证硬件电路的功能及该计算机程序代码的该第二部分中至少一者，其中该可编程电路用以执行该硬件电路的该功能，且该功能已被加至该集成电路。
22、与现有技术相比，本专利技术的有益效果是：
23、本专利技术使开发人员可以在软件平台上尝试新的设计理念和创新方式进行设计和仿真，推动集成电路设计的创新发展，减少实际硬件搭建和测试的次数，降低了开发成本，可以帮助开发人员发现和解决设计中的问题，快速完成设计任务，保证设计的质量和可靠性，提高设计效率。
24、上述概述仅仅是为了说明书的目的，并不意图以任何方式进行限制。除上述描述的示意性的方面、实施方式和特征之外，通过参考附图和以下的详细描述，本专利技术进一步的方面、实施方式和特征将会是容易明白的。
本文档来自技高网...【技术保护点】
1.集成电路开发系统，其特征在于，包括：逻辑设计模块、布局设计模块、布线设计模块、时序优化模块、功耗分析模块、仿真模块、制造验证模块，所述逻辑设计模块用于进行集成电路的逻辑设计，所述布局设计模块用于确定电路中各个元件的位置和大小，所述布线设计模块用于将逻辑元件用导线连接起来，所述时序优化模块用于优化电路的时序性能设计，所述功耗分析模块用于分析电路运行功耗，所述仿真模块用于对电路设计功能进行仿真验证，所述制造验证模块用于利用材料将设计好的芯片制造出来并检查其功能性。
2.根据权利要求1所述的集成电路开发系统，其特征在于：所述逻辑设计模块根据集成电路的需求分析来确定能够实现电路的设计逻辑，所述逻辑设计模块通过DesignCompiler将逻辑设计转换为门级网表，以便后续的布局布线过程，所述逻辑设计模块通过逻辑综合算法实现逻辑功能的最小化和优化，以满足电路的性能和功耗要求。
3.根据权利要求2所述的集成电路开发系统，其特征在于：所述布局设计模块根据电路设计逻辑和布局规则确定放置逻辑元件、连线和引脚的位置，所述布线设计模块根据电路设计布局和布线规则将布局设计转换为
4.根据权利要求3所述的集成电路开发系统，其特征在于：所述时序优化模块通过PrimeTime对设计进行时序分析，找出关键路径和时序问题，并根据分析结果进行优化，所述功耗分析模块通过PowerArtist对设计电路进行功耗分析、功耗优化和功耗验证。
5.根据权利要求4所述的集成电路开发系统，其特征在于：所述仿真模块通过物理验证方式来验证电路的物理布局是否满足设计要求，同时通过仿真工具的仿真测试过程对电路设计功能进行验证，所述制造验证模块通过工艺设计、版图设计和DRC/LVS检查来为芯片的制造做准备，然后通过掩膜制作、晶圆加工、封装测试将设计电路转化为实际的芯片产品。
6.根据权利要求5所述的集成电路开发系统，进一步地公开集成电路开发方法，其特征在于，包括：需求分析、逻辑结构、布局布线、时序功耗、仿真验证、后端制造，首先明确集成电路的功能需求和性能指标，并确定设计的基本目标；然后根据基本目标设计电路的逻辑功能，利用综合工具优化电路结构；之后根据约束条件确定电路中各种元件的位置和大小，形成实际的连线布线；然后结合时序分析工具优化电路的时序性能，分析电路的功耗特性并进行功耗优化；使用仿真软件对电路功能进行仿真验证，同时验证电路的物理布局是否满足设计要求；最后通过制造工艺将设计的芯片制造出来，并对芯片进行性能测试，准备投入市场应用。
7.根据权利要求6所述的集成电路开发方法，其特征在于：所述在逻辑结构中，使用逻辑门、寄存器传输级描述来描述电路的逻辑功能，综合处理将逻辑功能转换为门级网表并可以用于后续的布局布线，所述在时序功耗中，解决时序约束冲突并评估电路的功耗水平，进而提高电路的工作稳定性，延长电池寿命，所述在布局布线中，需要考虑电路的布局规则和时序约束，保证信号传输的稳定性和准确性。
8.集成电路，其特征在于，包括：
...【技术特征摘要】
1.集成电路开发系统，其特征在于，包括：逻辑设计模块、布局设计模块、布线设计模块、时序优化模块、功耗分析模块、仿真模块、制造验证模块，所述逻辑设计模块用于进行集成电路的逻辑设计，所述布局设计模块用于确定电路中各个元件的位置和大小，所述布线设计模块用于将逻辑元件用导线连接起来，所述时序优化模块用于优化电路的时序性能设计，所述功耗分析模块用于分析电路运行功耗，所述仿真模块用于对电路设计功能进行仿真验证，所述制造验证模块用于利用材料将设计好的芯片制造出来并检查其功能性。
2.根据权利要求1所述的集成电路开发系统，其特征在于：所述逻辑设计模块根据集成电路的需求分析来确定能够实现电路的设计逻辑，所述逻辑设计模块通过designcompiler将逻辑设计转换为门级网表，以便后续的布局布线过程，所述逻辑设计模块通过逻辑综合算法实现逻辑功能的最小化和优化，以满足电路的性能和功耗要求。
3.根据权利要求2所述的集成电路开发系统，其特征在于：所述布局设计模块根据电路设计逻辑和布局规则确定放置逻辑元件、连线和引脚的位置，所述布线设计模块根据电路设计布局和布线规则将布局设计转换为实际的连线布线，以满足电路的时序和功耗要求。
4.根据权利要求3所述的集成电路开发系统，其特征在于：所述时序优化模块通过primetime对设计进行时序分析，找出关键路径和时序问题，并根据分析结果进行优化，所述功耗分析模块通过powerartist对设计电路进行功耗分析、功耗优化和功耗验证。
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