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用于缩减面积的控制寄存器电路的方法与装置制造方法及图纸

技术编号:41524026 阅读:2 留言:0更新日期:2024-06-03 22:57
本申请公开一种用于缩减面积的控制寄存器电路的方法与装置。在所描述的示例中,一种装置(图2,241)包括:包含用于控制电路系统的控制位的一组控制寄存器(231),其被耦合以接收寄存器写入使能信号(WE0‑WE511)并接收输入数据;用于存储与控制位对应的数据的存储器(213),其被耦合以接收地址和存储器写入使能信号;解码电路系统(207),其被耦合以输出寄存器写入使能信号(WE0‑WE511);数据输出总线,其被耦合以从存储器接收数据但不连接到控制寄存器;以及控制器(215),其被耦合以接收地址、被耦合以在内部地址总线上输出地址、被耦合以输出写入使能信号并且被耦合以输出存储器写入使能信号,控制器被配置为促使数据被写入到与所接收的地址对应的所选择的控制寄存器,并促使数据同时被存储在与所接收的地址对应的存储器位置处。

【技术实现步骤摘要】

本申请总体涉及电子系统,并且更具体地涉及采用用于模拟、数字及混合信号电路的数字控制寄存器的系统。


技术介绍

1、广泛的电子系统采用需要大量控制信号的电路。这种系统的示例为通常包含在移动电子产品中的汽车雷达电路和将无线lan(局域网)与蓝牙(bluetoothtm)无线电结合在一起的电路。此类电路通常使用放大器、振荡器、滤波器、低功率睡眠模式以及需要控制的其它功能。这种控制的示例包含放大器增益设置、振荡器频率设置、滤波器系数、睡眠模式使能以及唤醒信号。对于复杂系统,这种控制通常由微处理器提供。然而,其它类型的电路(诸如状态机)可用于提供控制。一些复杂系统所要求的控制位的数量可能超过10000。

2、由于被控制的电路的并行功能,系统内的所有控制寄存器的各个位通常同时可用于被控制的电路。为了使能所有控制寄存器的所有控制位的这种同时存取,通常用触发器实施控制寄存器位。可以使用诸如锁存器的其它类型的存储元件。随机存取存储器(ram)通常不提供对所有位的同时存取并且因此通常不用作控制寄存器。随机存取存储器包含静态ram和动态ram,也包含非易失性存储器,诸如所谓的闪速存储器和基于磁存储单元的存储器。

3、除了由微处理器或其它类型的电路写入的能力之外,控制寄存器通常被实现为具有读取能力和“读取修改写入”能力。读取能力通常用于在写入之后验证控制寄存器的内容是正确的。当仅控制寄存器的位子集被修改时,通常使用读取修改写入能力。在多于一个处理器可以写入到相同的控制寄存器时,在多处理器系统中也经常使用读取修改写入能力。

<p>4、控制寄存器可以被实现为具有在低功率状态期间保持数据的能力。当从不活跃的低功率状态转变到正常的全功率操作时恢复系统功能时,这种能力是有利的。


技术实现思路

1、在所描述的示例中,一种装置包括:包含用于控制电路系统的控制位的一组控制寄存器,该组控制寄存器被耦合以从寄存器写入使能线接收寄存器写入使能信号,并且被耦合以从寄存器输入数据总线接收输入数据;存储器,用于存储对应于存储在该组控制寄存器中的控制位的数据,该存储器被耦合以从内部地址总线接收地址、被耦合以从输入数据总线接收存储器输入数据并且被耦合以接收存储器写入使能信号;解码电路系统,其被耦合以从内部地址总线接收地址并接收寄存器写入使能信号,并且被耦合以输出寄存器写入使能信号;数据输出总线,其被耦合以从存储器接收数据但不连接到控制寄存器;以及控制器,其被耦合以从地址总线接收地址、被耦合以在内部地址总线上输出地址、被耦合以输出写入使能信号并且被耦合以输出存储器写入使能信号,该控制器被配置为促使将数据从输入数据总线写入到与在地址总线上接收的地址对应的控制寄存器处的所选控制寄存器,并且促使该待写入的数据被同时存储在存储器中与在地址总线上接收的地址对应的存储器位置处。

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【技术保护点】

1.一种电路器件,其包括:

2.根据权利要求1所述的电路器件,其中所述控制器可操作以促使所述第一组数据被写入到所述一组控制寄存器中的寄存器和所述存储器。

3.根据权利要求1所述的电路器件,其中:

4.根据权利要求3所述的电路器件,其中:

5.根据权利要求4所述的电路器件,其中所述控制器可操作以促使在所述存储器的所述一组数据输出端处输出数据,所述数据存储在所述存储器中对应于在所述一组控制寄存器中与所述第一地址信号相对应的寄存器的存储器位置处。

6.根据权利要求1所述的电路器件,其中:

7.根据权利要求6所述的电路器件,其中所述控制器可操作以执行奇偶校验检查操作,所述奇偶校验检查操作包括:

8.根据权利要求1所述的电路器件,其中所述控制器进一步包括耦合到所述存储器的所述一组数据输出端的一组存储器数据输入端。

9.根据权利要求8所述的电路器件,其中所述控制器可操作以执行数据恢复操作,所述数据恢复操作包括:

10.根据权利要求9所述的电路器件,其中所述控制器可操作以响应于第一功率状态和第二功率状态之间的转变来执行所述数据恢复操作。

11.根据权利要求10所述的电路器件,其中所述存储器可操作以在所述第一功率状态和所述第二功率状态中保持数据。

12.根据权利要求9所述的电路器件,其中所述控制器可操作以响应于所述一组控制寄存器中的误差来执行所述数据恢复操作。

13.一种方法,其包括:

14.根据权利要求13所述的方法,其进一步包括:

15.根据权利要求13所述的方法,其进一步包括:

16.根据权利要求15所述的方法,其中执行所述数据恢复操作是响应于第一功率状态和第二功率状态之间的转变而被执行。

17.根据权利要求15所述的方法,其中执行所述数据恢复操作是响应于所述一组控制寄存器的数据误差而被执行。

18.根据权利要求13所述的方法,其进一步包括:

19.根据权利要求13所述的方法,其进一步包括:

20.根据权利要求19所述的方法,其进一步包括:响应于确定存在所述奇偶校验误差,将所述第二组数据存储在所述第二寄存器中。

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【技术特征摘要】

1.一种电路器件,其包括:

2.根据权利要求1所述的电路器件,其中所述控制器可操作以促使所述第一组数据被写入到所述一组控制寄存器中的寄存器和所述存储器。

3.根据权利要求1所述的电路器件,其中:

4.根据权利要求3所述的电路器件,其中:

5.根据权利要求4所述的电路器件,其中所述控制器可操作以促使在所述存储器的所述一组数据输出端处输出数据,所述数据存储在所述存储器中对应于在所述一组控制寄存器中与所述第一地址信号相对应的寄存器的存储器位置处。

6.根据权利要求1所述的电路器件,其中:

7.根据权利要求6所述的电路器件,其中所述控制器可操作以执行奇偶校验检查操作,所述奇偶校验检查操作包括:

8.根据权利要求1所述的电路器件,其中所述控制器进一步包括耦合到所述存储器的所述一组数据输出端的一组存储器数据输入端。

9.根据权利要求8所述的电路器件,其中所述控制器可操作以执行数据恢复操作,所述数据恢复操作包括:

10.根据权利要求9所述的电路器件,其中所述控制器可操作以响...

【专利技术属性】
技术研发人员:S·贾兰S·C·斯里瓦斯塔瓦M·纳比尔
申请(专利权)人:德克萨斯仪器股份有限公司
类型:发明
国别省市:

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