【技术实现步骤摘要】
本技术涉及一种半导体集成电路的验证装置，特别是涉及一种寄存器的验证装置。
技术介绍
1、基于arm架构的微控制单元(mcu)，一般都是先进高性能总线(advanced highperformance bus，amba)访问其它知识产权核(ip)的寄存器，所以只有一种数据总线转换，而且是在amba验证ip(verification ip，vip)中主动完成。
2、amba vip验证中，不采用通用验证方法学(universal verificationmethodology，uvm)寄存器(reg)模型即uvm_reg模型，而是直接通过发送amba指令读写寄存器
3、但是，现有技术中，寄存器所连接的总线虽然主要为amba总线，采用amba总线的ip核最大达70％以上，但是并不是全部寄存器的总线都为amba总线。所以，对连接不同总线的ip核的寄存器进行验证时，各个总线需要单独开发总线转化器，这会降低效率低下，复用性低。
4、另外，数据的发送模式或者优先级，由各个ip验证者(verifier)控制，即增加的验证的风险性，也对ip verifier有一定要求。
技术实现思路
1、本技术所要解决的技术问题是提供一种寄存器的验证装置，能实现基于uvm寄存器模型以及支持多种协议总线读写寄存器的验证，且能提高寄存器模型的复用性，能极大的简化验证测试序列的开发，从而能提高验证效率以及可靠性。
2、为此，本技术提供的寄存器的验证装置包括：多个uvm寄存器
3、各所述寄存器分别和对应的总线相连，所述总线包括多种类型。
4、适配器(adapter)。
5、所述适配器的第一侧和各所述uvm寄存器模型连接。
6、所述适配器的第二侧分别和各种类型的所述总线连接，各种类型的所述总线对所述适配器形成复用结构。
7、进一步的改进是，所述适配器包括：地址解析模块，数据仲裁模块和总线转换模块。
8、进一步的改进是，所述地址解析模块所解析的地址为被选择的所述寄存器所对应的地址并根据所述地址将测试序列挂载到对应的所述总线上。
9、进一步的改进是，所述数据仲裁模块所仲裁的数据发送方式包括并行发送和串行发送。
10、进一步的改进是，所述总线转换模块将所述测试序列中的uvm寄存器模型项目转换对应的总线测试序列项目。
11、进一步的改进是，还包括和各种类型的所述总线一一对应的测试序列器和驱动器。
12、所述测试序列器接收所述适配器传输的所述总线测试序列项目。
13、所述驱动器接收所述总线测试序列项目。
14、所述驱动器还将所述总线测试序列项目的数据转换为所连接的所述被测设备中的所述寄存器的物理接口协议格式并将格式转换后的所述总线测试序列项目的数据传输给对应的所述寄存器。
15、进一步的改进是，各种类型的所述总线所对应的所述测试序列器和所述驱动器都封装在同一个总线代理器(agent)中。
16、进一步的改进是，各所述总线代理器中还封装有监视器(monitor)，所述监视器收集从对应的所述寄存器中传输的信息。
17、进一步的改进是，根据类型，所述总线分为swd总线、amba总线和io总线。
18、进一步的改进是，所述amba总线包括ahb总线。
19、进一步的改进是，所述被测设备包括多个ip核，各所述ip核分别和对应的所述总线连接，同一所述ip核中的各所述寄存器都连接同一所述总线。
20、进一步的改进是，还包括和各所述总线代理器一一对应的预测器(predictor)。
21、所述预测器接收所述监视器所收集的信息。
22、所述预测器还接收所述适配器传输的对应的所述总线的句柄。
23、进一步的改进是，还包括：寄存器地图器；所述寄存器地图器中存储有各所述寄存器的地址。
24、所述地址解析模块从所述寄存器地图器获得所述寄存器的地址。
25、本技术中，顶层的适配器能将uvm寄存器模型中的数据流转换成符合各种类型的总线协议的数据，所以，具有多种类型的总线时采用一个适配器即可，不需要每一种类型总线都需要单独配置一个适配器，能提高寄存器模型的复用性，也即能提高验证平台在项目迭代方面的复用性，能统一寄存器读写的方法，能极大的简化验证测试序列的开发，从而能提高验证效率以及可靠性，还能减轻ip验证工程师的负担。
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1.一种寄存器的验证装置，其特征在于，包括：多个UVM寄存器模型，各所述UVM寄存器模型和被测设备中寄存器一一对应；
2.如权利要求1所述的寄存器的验证装置，其特征在于：所述适配器包括：地址解析模块，数据仲裁模块和总线转换模块。
3.如权利要求2所述的寄存器的验证装置，其特征在于：所述地址解析模块所解析的地址为被选择的所述寄存器所对应的地址并根据所述地址将测试序列挂载到对应的所述总线上。
4.如权利要求3所述的寄存器的验证装置，其特征在于：所述数据仲裁模块所仲裁的数据发送方式包括并行发送和串行发送。
5.如权利要求3所述的寄存器的验证装置，其特征在于：所述总线转换模块将所述测试序列中的UVM寄存器模型项目转换对应的总线测试序列项目。
6.如权利要求5所述的寄存器的验证装置，其特征在于，还包括和各种类型的所述总线一一对应的测试序列器和驱动器；
7.如权利要求6所述的寄存器的验证装置，其特征在于：各种类型的所述总线所对应的所述测试序列器和所述驱动器都封装在同一个总线代理器中。
8.如权利要求7所述的寄
9.如权利要求7所述的寄存器的验证装置，其特征在于：根据类型，所述总线分为SWD总线、AMBA总线和IO总线。
10.如权利要求9所述的寄存器的验证装置，其特征在于：所述AMBA总线包括AHB总线。
11.如权利要求1所述的寄存器的验证装置，其特征在于：所述被测设备包括多个IP核，各所述IP核分别和对应的所述总线连接，同一所述IP核中的各所述寄存器都连接同一所述总线。
12.如权利要求8所述的寄存器的验证装置，其特征在于：还包括和各所述总线代理器一一对应的预测器；
13.如权利要求3所述的寄存器的验证装置，其特征在于，还包括：寄存器地图器；所述寄存器地图器中存储有各所述寄存器的地址；
...【技术特征摘要】
1.一种寄存器的验证装置，其特征在于，包括：多个uvm寄存器模型，各所述uvm寄存器模型和被测设备中寄存器一一对应；
2.如权利要求1所述的寄存器的验证装置，其特征在于：所述适配器包括：地址解析模块，数据仲裁模块和总线转换模块。
3.如权利要求2所述的寄存器的验证装置，其特征在于：所述地址解析模块所解析的地址为被选择的所述寄存器所对应的地址并根据所述地址将测试序列挂载到对应的所述总线上。
4.如权利要求3所述的寄存器的验证装置，其特征在于：所述数据仲裁模块所仲裁的数据发送方式包括并行发送和串行发送。
5.如权利要求3所述的寄存器的验证装置，其特征在于：所述总线转换模块将所述测试序列中的uvm寄存器模型项目转换对应的总线测试序列项目。
6.如权利要求5所述的寄存器的验证装置，其特征在于，还包括和各种类型的所述总线一一对应的测试序列器和驱动器；
7.如权利要求6所述的寄存器的验证装置，其特征在于：各...
【专利技术属性】
技术研发人员：雷冬梅，
申请(专利权)人：普冉半导体上海股份有限公司，
类型：新型
国别省市：
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