【技术实现步骤摘要】
本专利技术涉及电子电路，尤其涉及一种多通道控制信号复用的串并转换电路。
技术介绍
1、目前的调相电路主要分为模拟调相电路与数字调相电路，模拟调相电路由于利用模拟器件产生调相，具有调相时间尺度大、调相时间固定以及调相精度差等缺点，从而限制了它的应用。数字调相电路具有调相精度高、时间可编程等优点。
2、但是的数字调相电路目前只能用专用芯片来实现，随着技术的发展，芯片通讯速率提高，数据量不断增大，芯片所需的引脚也越来越多，从而导致专用可编程调相芯片价格比较昂贵，增加了电路设计的成本。
技术实现思路
1、本专利技术的目的在于提供一种多通道控制信号复用的串并转换电路，旨在解决现有电路数据量增大，需要使用专用芯片，增加电路设计成本的问题。
2、为实现上述目的，本专利技术提供了一种多通道控制信号复用的串并转换电路，包括数据模块、选择模块、时钟模块、数据转换模块和输出选择模块，所述数据模块、所述选择模块、所述时钟模块、所述数据转换模块和所述输出选择模块依次连接；
3、所述数据模块，用于多通道的数据输入并对数据进行缓冲，得到原始输入数据，向所述选择模块输出所述原始输入数据；
4、所述选择模块，用于获取所述原始输出数据中的并行输入数据，得到选择信号，并基于所述选择信号生成触发所述时钟模块的触发信号；
5、所述时钟模块，用于对所述触发信号进行分频处理，得到时钟信号；
6、所述数据转换模块，用于对所述时钟信号进行延时处理，得到延时信号
7、所述输出选择模块，用于选择所述输出数据进行输出。
8、其中，所述数据模块包括输入电路和缓存器，所述缓存器与所述输入电路连接；
9、所述输入电路，用于获取多通道的输入数据，得到所述数据输入；
10、所述缓存器，用于存储所述数据输入，得到所述原始输入数据。
11、其中，所述选择模块包括通路选择器、触发器和缓冲器，所述通路选择器、所述触发器和所述缓冲器依次连接；
12、所述通路选择器，用于选择获取多通道的并行输入数据，得到所述选择信号；
13、所述触发器，基于所述选择信号生成所述触发信号；
14、所述缓冲器，用于对所述输入电路提供稳定的输出阻。
15、其中，所述时钟模块包括分频单元和时钟单元，所述分频单元和所述时钟单元连接；
16、所述分频单元，用于对所述触发信号进行分频处理，得到分频信号；
17、所述时钟单元，基于所述分频信号生成时钟信号。
18、其中，所述数据转换模块包括数据转换单元和使能信号发生器，所述数据转换单元与所述使能信号发生器连接；
19、所述数据转换单元，用于对所述时钟信号进行延时处理，得到延时信号，并对所述延时信号对所述原始输入数据进行串并转换，得到输出数据；
20、所述使能信号发生器，用于对所述延时信号进行串并转换，提供低电平的使能配置信号。
21、其中，所述数据转换单元包括延时子单元和转换子单元，所述延时子单元和所述转换子单元连接；
22、所述延时子单元，用于对所述时钟信号进行延时处理，得到所述延时信号；
23、所述转换子单元，基于所述延时信号对所述原始输入数据进行串并转换，得到输出数据。
24、其中，所述时钟信号和所述输出数据至少包括三个。
25、本专利技术的一种多通道控制信号复用的串并转换电路，所述数据模块用于多通道的数据输入并对数据进行缓冲，得到原始输入数据，并向所述选择模块输出所述原始输入数据，所述选择模块获取所述原始输出数据中的并行输入数据，得到选择信号，并基于所述选择信号生成触发所述时钟模块的触发信号，所述时钟模块对所述触发信号进行分频处理，得到时钟信号，所述数据转换模块对所述时钟信号进行延时处理，得到延时信号，并基于所述延时信号对所述原始输入数据进行串并转换，得到输出数据，最后通过所述输出选择模块选择所述输出数据进行输出，该串并转换电路将输入信号进行延时时钟处理，在数据的接收端将串行的数据转换为并行的数据，从而提升数据的传输速度，避免了多引脚芯片的使用，大大减少了电路设计的成本，解决现有电路数据量增大，需要使用专用芯片，增加电路设计成本的问题。
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【技术特征摘要】
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【专利技术属性】
技术研发人员：苏伟，龚科，石登强，唐元波，艾静，
申请(专利权)人：成都信和创业科技有限责任公司，
类型：发明
国别省市：
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