【技术实现步骤摘要】
【国外来华专利技术】具有包括蚀刻停止/场控制层的多层栅极电介质层的功率半导体装置及形成此装置的方法
[0001]相关申请的交叉引用
[0002]本申请要求于2020年7月7日提交的美国专利申请序列No.16/922,192的优先权,该美国专利申请的全部内容通过引用并入本文。
[0003]本专利技术涉及半导体装置,并且更具体而言,涉及功率半导体切换装置。
技术介绍
[0004]金属绝缘半导体场效应晶体管(“MISFET”)是众所周知类型的可以被用作切换装置的半导体晶体管。MISFET是具有栅极、漏极和源极端子以及半导体主体的三端子装置。源极区域和漏极区域形成在半导体主体中,由沟道区域分开,并且栅极电极(可以充当栅极端子或电连接到栅极端子)通过被称为“栅极电介质层”的薄绝缘层与沟道区域分开。可以通过向栅极电极施加偏置电压来接通或关断MISFET。当MISFET接通时(即,它处于其“导通状态”),电流通过源极区域与漏极区域之间的MISFET的沟道区域传导。当偏置电压从栅极电极移除(或降低到阈值电平以下)时,电流停止通过沟道区域传导。举例来说,n型MISFET具有n型源极和漏极区域以及p型沟道。因此,n型MISFET具有“n
‑
p
‑
n”设计。当向栅极电极施加足以在电连接n型源极区域和漏极区域的p型沟道区域中产生导电n型反向层的栅极偏置电压时,n型MISFET接通,从而允许n型源极区域和漏极区域之间的多数载流子传导。
[0005]在大多数情况下,将功率MISFET的栅极电极与沟道区域分 ...
【技术保护点】
【技术特征摘要】
【国外来华专利技术】1.一种半导体装置,包括:包括碳化硅的半导体层结构;在所述半导体层结构上的栅极电介质层,所述栅极电介质层包括在所述半导体层结构上的基部栅极电介质层和与所述半导体层结构相对地在所述基部栅极电介质层上的盖帽栅极电介质层;以及与所述半导体层结构相对地在所述栅极电介质层上的栅极电极,其中,所述盖帽栅极电介质层的介电常数高于所述基部栅极电介质层的介电常数。2.根据权利要求1所述的半导体装置,其中,所述盖帽栅极电介质层比所述基部栅极电介质层薄。3.根据权利要求1或2所述的半导体装置,其中,所述基部栅极电介质层包括氧化硅层。4.根据权利要求3所述的半导体装置,其中,所述基部栅极电介质层的厚度是所述盖帽栅极电介质层的至少五倍,并且所述盖帽栅极电介质层的介电常数是所述基部栅极电介质层的介电常数的至少三倍。5.根据权利要求1
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4中的任一项所述的半导体装置,其中,所述栅极电极包括硅。6.根据权利要求1
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5中的任一项所述的半导体装置,其中,所述半导体层结构还包括由JFET区域分开的第一阱区域和第二阱区域,并且其中所述盖帽栅极电介质层不在所述JFET区域的上表面上。7.根据权利要求1
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6中的任一项所述的半导体装置,其中,所述栅极电极具有阶梯状的下表面。8.根据权利要求1
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7中的任一项所述的半导体装置,其中,所述栅极电极的相对的上边缘比所述栅极电极的上表面的中心部分在所述半导体层结构上方更远。9.根据权利要求1
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8中的任一项所述的半导体装置,其中,所述盖帽栅极电介质层仅在所述基部栅极电介质层的一部分上。10.根据权利要求1
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9中的任一项所述的半导体装置,其中,所述半导体层结构包括具有第一导电类型的漂移层、位于所述漂移层的上部中的具有第二导电类型的阱以及位于所述阱的上部中的具有第一导电类型的源极区域,以及其中,沟道区域设置在所述源极区域与所述漂移层的直接接触所述栅极电介质层的一部分之间的所述阱中。11.根据权利要求10所述的半导体装置,其中,所述盖帽栅极电介质层形成在所述源极区域上并且不形成在所述漂移层的直接接触所述栅极电介质层的所述一部分上。12.根据权利要求1
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11中的任一项所述的半导体装置,其中,所述半导体装置被配置为使得在导通状态操作期间,所述栅极电介质层中的峰电场值将基本上位于所述栅极电极的侧边缘下方的所述基部栅极电介质层的上表面处。13.根据权利要求1
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12中的任一项所述的半导体装置,其中,所述半导体装置被配置为使得在导通状态操作期间,所述基部栅极电介质层中的峰电场值比所述盖帽栅极电介质层中的峰电场值大至少50%。14.根据权利要求1
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13中的任一项所述的半导体装置,其中,所述半导体装置是金属绝缘体半导体场效应晶体管(“MISFET”)或绝缘栅双极晶体管(“IGBT”)。15.根据权利要求1
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14中的任一项所述的半导体装置,其中,所述栅极电介质层的厚度
是至少二十五纳米。16.根据权利要求1
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15中的任一项所述的半导体装置,其中,所述盖帽栅极电介质层包括相对于所述栅极电极的蚀刻停止层。17.根据权利要求1
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16中的任一项所述的半导体装置,其中,所述基部栅极电介质层的厚度除以所述基部栅极电介质层的材料的介电常数与所述盖帽栅极电介质层的厚度除以所述盖帽栅极电介质层的材料的介电常数之比至少为十。18.根据权利要求1
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17中的任一项所述的半导体装置,其中,所述半导体层结构包括在其上表面中的沟槽,并且其中所述栅极电介质层和所述栅极电极各自至少部分地在所述沟槽内。19.根据权利要求18所述的半导体装置,其中,所述沟槽的至少一些拐角是变圆的拐角。20.一种半导体装置,包括:包括碳化硅的半导体层结构;在所述半导体层结构上的栅极电介质层;以及与所述半导体层结构相对地在所述栅极电介质层上的栅极电极,其中,所述半导体装置被配置为使得在导通状态操作期间所述栅极电介质层中的峰电场在所述栅极电介质层的顶表面下方。21.根据权利要求20所述的半导体装置,其中,所述栅极层包括在所述半导体层结构上的基部栅极电介质层和与所述半导体层结构相对地在所述基部栅极电介质层上的盖帽栅极电介质层。22.根据权利要求21所述的半导体装置,其中,所述半导体装置被配置为使得在导通状态操作期间所述栅极电介质层中的峰电场在所述基部栅极电介质层中。23.根据权利要求22所述的半导体装置,其中,所述半导体装置被配置为使得在导通状态操作期间所述栅极电介质层中的峰电场基本上位于所述栅极电极的侧边缘下方的所述基部栅极电介质层的上表面处。24.根据权利要求20所述的半导体装置,其中,所述半导体装置被配置为使得在导通状态操作期间所述栅极电介质层中的峰电场在所述栅极电介质层的顶表面下方至少2nm。25.根据权利要求21
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23中的任一项所述的半导体装置,其中,所述盖帽栅极电介质层比所述基部栅极电介质层薄。26.根据权利要求21
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23中的任一项所述的半导体装置,其中,所述基部栅极电介质层包括氧化硅层并且所述栅极电极包括硅。27.根据权利要求21
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26中的任一项所述的半导体装置,其中,所述基部栅极电介质层的厚度是所述盖帽栅极电介质层的至少五倍,并且所述盖帽栅极电介质层的介电常数是所述基部栅极电介质层的介电常数的至少三倍。28.根据权利要求27所述的半导体装置,其中,所述半导体层结构包括具有第一导电类型的漂移层、在所述漂移层的间隔开的上部中的各自具有第二导电类型的第一阱和第二阱、在相应的第一阱和第二阱的上部中的具有第一导电类型的第一源极区域和第二源极区域、在所述第一阱与所述第二阱之间的具有第一导电类型的JFET区域、以及设置在相应的第一源极区域和第二源极区域与所述JFET区域之间的相应的第一阱和第二阱中的第一沟
道区域和第二沟道区域。29.根据权利要求28所述的半导体装置,其中,所述盖帽栅极电介质层不在所述JFET区域的上表面上。30.根据权利要求20
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29中的任一项所述的半导体装置,其中,所述栅极电极具有阶梯状的下表面。31.根据权利要求20
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30中的任一项所述的半导体装置,其中,所述栅极电极的相对的上边缘比所述栅极电极的上表面的中心部分在所述半导体层结构上方更远。32.根据权利要求21
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31中的任一项所述的半导体装置,其中,所述盖帽栅极电介质层仅形成在所述基部栅极电介质层的一部分上。33.根据权利要求21
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32中的任一项所述的半导体装置,其中,所述半导体装置被配置为使得在导通状态操作期间,所述栅极电介质层中的峰电场值将基本上位于所述栅极电极的侧边缘下方的所述基部栅极电介质层的上表面处。34.根据权利要求21
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33中的任一项所述的半导体装置,其中,所述半导体装置被配置为使得在导通状态操作期间,所述基部栅极电介质层中的峰电场值比所述盖帽栅极电介质层中的峰电场值大至少50%。35.根据权利要求21
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34中的任一项所述的半导体装置,其中,所述基部栅极电介质层的厚度除以所述基部栅极电介质层的材料的介电常数与所述盖帽栅极电介质层的厚度除以所述盖帽栅极电介质层的材料的介电常数之比至少为十...
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