本发明专利技术公开了一种基于系统中断设计的报警装置及方法，包括下位机、上位机、ROUTER数据总线路由器，所述上位机包括PCIE驱动程序单元和Application单元，所述ROUTER数据总线路由器包括Alarm处理模块和Rx_Tx_Bus数据收发总线，所述PCIE驱动程序单元包括依次连接的ISR中断处理模块和DPC延迟中断处理模块，所述Application单元包括Alarm Thread中断处理线程，本发明专利技术不仅避免了Alarm信号传输对原本上位机与下位机正常数据交换的影响，而且解决了频繁查询Alarm状态带来的操作系统卡顿，同时Alarm信号处理的实时性高。Alarm信号处理的实时性高。Alarm信号处理的实时性高。
【技术实现步骤摘要】
一种基于系统中断设计的报警装置及方法
[0001]本专利技术涉及一种基于系统中断设计的报警装置及方法，属于集成电路自动测试设备领域。
技术介绍
[0002]多数自动化测试设备由上位机和下位机组成，上位机和下位机之间由通信总线连接，传递指令和数据。在下位机执行测试程序的过程中，需要监控很多参数如电压，温度等，以及当一些测试指标发生异常时能及时作出响应，如停止测试，关闭电源等。
[0003]现有技术方案如图1所示，包括以下部件：Board 1
‑
N数字板卡为下位机处理数字信号的硬件单元，一台下位机可以配置多个数字板卡。
[0004]Board 0接口板卡为下位机负责校准，补偿等功能的硬件单元。
[0005]ROUTER数据总线路由器负责下位机和上位机数据交换的硬件单元，连接上位机，Digital Board，Utility Board等各组件。
[0006]上位机（PC）负责向下位机发送指令或读写数据。
[0007]Module 0
‑
N为板卡的各个功能模块。
[0008]Board Router 1
‑
N为数字板卡路由器，用于和总线路由器通信。
[0009]Rx_Tx_Bus为PCIE数据收发总线，用于接收和发送连接上位机和下位机光纤上的PCIE物理层数据，并且负责从物理层到事务层，最终到有效数据这一过程的解析。
[0010]PCIE为PCIE驱动程序，负责接收应用程序的查询请求或者上位机对下位机的数据读写请求。
[0011]Board ROUTER 0为接口板卡路由器，用于和总线路由器通信。
[0012]Application为用户编写的测试程序。
[0013]上位机（通常为PC）的应用程序会发起IRQ（设备状态查询请求），PCIE在接收到IRQ后会向下位机的ROUTER（总线路由器）发送Alarm查询请求包，该请求包按照PICE协议以TLP（事务层数据包）的形式通过连接上位机和下位机的光纤传输。ROUTER在解析TLP后会判断这一次传输的数据是否为Alarm查询请求，之后ROUTER会访问各个测试板卡，读取各个板卡功能模块的寄存器，取回该模块的Alarm状态值。
[0014]在现有的技术框架下，存在以下缺陷：1、下位机无法主动发起数据交换请求，所有的数据交换或者指令传递都是由上位机首先在总线上发起读写请求来完成的。
[0015]2、频繁的状态查询会占用总线，阻塞正常的指令或者数据传输；如果降低上位机的查询频率，则会影响设备状态监控的实时性，也可能导致一些需要紧急响应的情况得不到及时处理，例如功能模块电源电压过载时需要紧急关机保护测试设备或者被测设备等情况。
[0016]3、高频率的状态查询也会占用上位机的CPU，导致应用程序运行卡顿，操作系统无
法及时响应用户界面操作。
技术实现思路
[0017]专利技术目的：为了解决现有技术中，处理下位机Alarm信号所遇到的实时性与程序运行效率的矛盾，以及Alarm查询请求与正常数据交换互相阻塞的问题，本专利技术提供一种基于系统中断设计的报警装置及方法。
[0018]技术方案：为实现上述目的，本专利技术采用的技术方案为：一种基于系统中断设计的报警装置，包括下位机、上位机、ROUTER数据总线路由器，所述上位机包括PCIE驱动程序单元和Application单元，所述ROUTER数据总线路由器包括Alarm处理模块和Rx_Tx_Bus数据收发总线，所述PCIE驱动程序单元包括依次连接的ISR中断处理模块和DPC延迟中断处理模块，所述Application单元包括Alarm Thread中断处理线程，其中：所述Alarm处理模块用于处理下位机的Alarm数据得到Alarm信号，将处理得到的Alarm信号通过Alarm信号线传送给ISR中断处理模块，将处理得到的Alarm信号传送给Rx_Tx_Bus数据收发总线。
[0019]所述ISR中断处理模块用于处理Alarm信号中的Alarm中断向量，并将Alarm中断向量请求放入DPC队列。
[0020]所述DPC延迟中断处理模块用于根据Alarm中断向量请求处理具体中断向量，完成中断响应的业务逻辑。同时DPC延迟中断处理模块在接收Alarm中断向量请求后解除Alarm Thread的等待状态，形成Alarm同步事件，同时将Alarm同步事件传递给Alarm Thread中断处理线程。
[0021]所述Alarm Thread中断处理线程用于根据Alarm同步事件，发起Alarm查询请求。
[0022]优选的：所述下位机包括Board 1
‑
N数字板卡和Board 0接口板卡，所述Board 1
‑
N数字板卡包括一一对应连接的Board1
‑
N功能模块和Board Router 1
‑
N数字板卡路由器，所述Board 0接口板卡包括依次连接的Board 0功能模块和Board ROUTER 0接口板卡路由器。
[0023]优选的：所述ISR中断处理模块设置有处理Alarm的即时中断处理函数ISR。
[0024]优选的：所述DPC延迟中断处理模块设置有处理Alarm的延迟中断处理函数DPC。
[0025]优选的：所述Alarm信号线与Rx_Tx_Bus数据收发总线相互独立。
[0026]优选的：所述Alarm信号线与Rx_Tx_Bus数据收发总线为光纤。
[0027]一种基于系统中断设计的报警方法，采用上述基于系统中断设计的报警装置，包括以下步骤：步骤1，通过Application单元启动测试程序，Application单元创建Alarm Thread中断处理线程，Alarm Thread中断处理线程创建后一直处于阻塞状态，等待同步事件Alarm Event。
[0028]步骤2，当下位机产生Alarm数据后，各板卡功能模块会将Alarm数据Alarm0
‑
N保存在各自的寄存器中。
[0029]步骤3，ROUTER数据总线路由器向PCIE驱动程序单元发送Alarm中断向量，触发ISR中断处理模块中的即时中断处理函数ISR。
[0030]步骤4，在DPC延迟中断处理模块中，需要识别本次中断向量是否为Alarm中断请
求，并激发Alarm Thread等待的同步事件Alarm Event。
[0031]步骤5，同步事件Alarm Event被激发后，Alarm Thread中断处理线程结束等待并继续运行，发起Alarm查询请求IRQ。
[0032]步骤6，PCIE驱动程序单元在收到Alarm查询请求IRQ后，会打包该请求得到事务层数据包TLP，并向ROUTER数据总线路由器发送事务层数据包TLP。
[0033]步骤7，ROUTER数据总线路由器解析事务层数据包TLP得到Alarm查询请本文档来自技高网...
【技术保护点】
【技术特征摘要】
1.一种基于系统中断设计的报警装置，包括下位机、上位机、ROUTER数据总线路由器，所述上位机包括PCIE驱动程序单元和Application单元，其特征在于：所述ROUTER数据总线路由器包括Alarm处理模块和Rx_Tx_Bus数据收发总线，所述PCIE驱动程序单元包括依次连接的ISR中断处理模块和DPC延迟中断处理模块，所述Application单元包括Alarm Thread中断处理线程，其中：所述Alarm处理模块用于处理下位机的Alarm数据得到Alarm信号，将处理得到的Alarm信号通过Alarm信号线传送给ISR中断处理模块，将处理得到的Alarm信号传送给Rx_Tx_Bus数据收发总线；所述ISR中断处理模块用于处理Alarm信号中的Alarm中断向量，并将Alarm中断向量请求放入DPC队列；所述DPC延迟中断处理模块用于根据Alarm中断向量请求处理具体中断向量，完成中断响应的业务逻辑；同时DPC延迟中断处理模块在接收Alarm中断向量请求后解除Alarm Thread的等待状态，形成Alarm同步事件，同时将Alarm同步事件传递给Alarm Thread中断处理线程；所述Alarm Thread中断处理线程用于根据Alarm同步事件，发起Alarm查询请求。2.根据权利要求1所述基于系统中断设计的报警装置，其特征在于：所述下位机包括Board 1
‑
N数字板卡和Board 0接口板卡，所述Board 1
‑
N数字板卡包括一一对应连接的Board 1
‑
N功能模块和Board Router 1
‑
N数字板卡路由器，所述Board 0接口板卡包括依次连接的Board 0功能模块和Board ROUTER 0接口板卡路由器。3.根据权利要求2所述基于系统中断设计的报警装置，其特征在于：所述ISR中断处理模块设置有处理Alarm的即时中断处理函数ISR。4.根据权利要求3所述基于系统中断设计的报警装置，其特征在于：所述DPC延迟中断处理模块设置有处理Alarm的延...
【专利技术属性】
技术研发人员：黄冬平，郭显炜，
申请(专利权)人：上海谐振半导体科技有限公司，
类型：发明
国别省市：
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