【技术实现步骤摘要】
半导体装置
[0001]相关申请
[0002]本申请享受以日本专利申请2021
‑
154763号(申请日:2021年9月22日)为基础申请的优先权。本申请通过参考该基础申请包括基础申请的全部内容。
[0003]实施方式主要涉及半导体装置。
技术介绍
[0004]作为下一代的半导体器件用的材料,碳化硅受到期待。碳化硅与硅相比,具有带隙为3倍、破坏电场强度为约10倍、导热率为约3倍这样优异的物性。如果有效利用该特性,则例如能够实现高耐压、低损耗且能够高温工作的金属氧化物半导体场效应晶体管(MOSFET:Metal
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Oxide
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Semiconductor Field
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Effect Transistor)。
[0005]使用碳化硅的纵型MOSFET具有pn结二极管作为内置二极管。例如,MOSFET被用作与感应性负载连接的开关元件。在该情况下,即使MOSFET为截止状态,通过使用pn结二极管,也能够流过回流电流。
[0006]但是,若使用双极动作的pn结二极管流过回流电流,则由于载流子的再结合能量而层叠缺陷在碳化硅层中生长。当层叠缺陷在碳化硅层中生长时,会产生MOSFET的导通电阻增大的问题。MOSFET的导通电阻的增大导致MOSFET的可靠性的降低。例如,通过在MOSFET中设置作为内置二极管而双极动作的肖特基势垒二极管(SBD:Schottky Barrier Diode),能够抑制碳化硅层中的层叠缺陷。
...
【技术保护点】
【技术特征摘要】
1.一种半导体装置,具备:元件区域,包含晶体管、第一二极管以及第一接触部;终端区域,包围所述元件区域且包含第二接触部;以及中间区域,设置于所述元件区域与所述终端区域之间,不包含所述晶体管、所述第一二极管、所述第一接触部以及所述第二接触部,所述元件区域包含:第一电极;第二电极;栅极电极;碳化硅层,设置于所述第一电极与所述第二电极之间,具有所述第一电极侧的第一面和所述第二电极侧的第二面,所述碳化硅层包含:第一导电型的第一碳化硅区域,具有与所述第一面接触且与所述栅极电极对置的第一区域、以及与所述第一面接触且与所述第一电极接触的第二区域;第二导电型的第二碳化硅区域,设置于所述第一碳化硅区域与所述第一面之间,与所述第一区域相邻,与所述栅极电极对置,且在第一界面处与所述第一电极接触;和第一导电型的第三碳化硅区域,设置于所述第二碳化硅区域与所述第一面之间,且与所述第一电极电连接;以及栅极绝缘层,设置于所述栅极电极与所述第二碳化硅区域之间、所述栅极电极与所述第一区域之间,所述终端区域包含:与所述第一电极电连接的第一布线层;所述第二电极;以及所述碳化硅层,包含所述第一碳化硅区域以及设置于所述第一碳化硅区域与所述第一面之间且在第二界面处与所述第一布线层接触的第二导电型的第四碳化硅区域,所述中间区域包含所述碳化硅层,所述碳化硅层包含所述第一碳化硅区域以及设置于所述第一碳化硅区域与所述第一面之间的第二导电型的第五碳化硅区域,所述晶体管包含所述栅极电极、所述栅极绝缘层、所述第一区域、所述第二碳化硅区域和所述第三碳化硅区域,所述第一二极管包含所述第一电极和所述第二区域,所述第一接触部包含所述第一界面,所述第二接触部包含所述第二界面,从所述元件区域朝向所述终端区域的方向的所述中间区域的宽度为所述碳化硅层的厚度的2倍以上。2.根据权利要求1所述的半导体装置,其中,所述中间区域还包含将所述第一电极与所述第一布线层连接的连接层,所述连接层不与所述第五碳化硅区域接触。3.根据权利要求2所述的半导体装置,其中,所述栅极电极在与所述第一面平行的第一方向上延伸。4.根据权利要求3所述的半导体装置,其中,
所述连接层设置于所述第一电极的第二方向上,所述第二方向与所述第一面平行且与所述第一方向垂直。5.根据权利要求4所述的半导体装置,其中,所述第一布线层具有:在所述第二方向上延伸的第一部分;第二部分,在所述第二方向上延伸,且在该第二部分与所述第一部分之间夹着所述第一电极;在所述第一方向上延伸的第三部分;以及第四部分,在所述第一方向上延伸,且在该第四部分与所述第三部分之间夹着所述第一电极,所述连接层设置于所述第一电极与所述第四部分之间。6.根据权利要求5所述的半导体装置,其中,所述中间区域还包含栅极电极焊盘和与所述栅极电极焊盘电连接的第二布线层,所述栅极电极经由所述第二布线层而与所述栅极电极焊盘电连接,所述第二布线层具有:第一线,在所述第二方向上延伸,且设置于所述第一部分与所述第一电极之间;以及第二线,在所述第二方向上延伸,且设置于所述第二部分与所述第一电极之间...
【专利技术属性】
技术研发人员:尾形昂洋,大桥辉之,河野洋志,
申请(专利权)人:东芝电子元件及存储装置株式会社,
类型:发明
国别省市:
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