本发明专利技术描述用于存储器装置的延迟校准振荡器的方法、系统及装置。在一些实例中，存储器装置可包含可在包含脉冲产生器的环形振荡器配置中操作(例如，用于校准操作)的延迟链。所述脉冲产生器可经配置以响应于输入信号的转换而输出脉冲信号。通过在环形振荡器的反馈回路中产生脉冲信号，所述环形振荡器可支持不依赖于整个所述延迟链中的第一转换传播遍次(例如，上升边缘传播)及响应性反向转换传播遍次(例如，下降边缘传播)两者的循环，所述循环可支持更接近地表示拟被校准的所述延迟链的方面的环形振荡器循环时间(例如，周期)。周期)。周期)。
【技术实现步骤摘要】
【国外来华专利技术】用于存储器装置的延迟校准振荡器
[0001]交叉参考
[0002]本专利申请案主张2020年5月12日申请的阿卡松(Akamatsu)的名为“用于存储器装置的延迟校准振荡器(DELAY CALIBRATION OSCILLATORS FOR A MEMORY DEVICE)”的美国专利申请案第15/930,133号的优先权，所述美国专利申请案转让给其受让人且明确地以全文引用的方式并入本文中。
技术介绍
[0003]以下内容大体上涉及一或多个存储器系统，且更特定地说涉及用于存储器装置的延迟校准振荡器。
[0004]存储器装置广泛地用于在例如计算机、无线通信装置、相机、数字显示器及类似者的各种电子装置中存储信息。信息是通过使存储器装置内的存储器单元编程为各种状态来存储。举例来说，二元存储器单元可经编程为常常通过逻辑1或逻辑0指明的两个经支持状态中的一者。在一些实例中，单一存储器单元可支持两个以上状态，所述状态中的任一者可予以存储。为了存取所存储信息，装置的组件可读取或感测存储器装置中的至少一种所存储状态。为了存储信息，装置的组件可在存储器装置中写入或编程状态。
[0005]存在各种类型的存储器装置，包含磁性硬盘、随机存取存储器(RAM)、只读存储器(ROM)、动态RAM(DRAM)、同步动态RAM(SDRAM)、铁电RAM(FeRAM)、磁性RAM(MRAM)、电阻式RAM(RRAM)、快闪存储器、相变存储器(PCM)及其它者。存储器装置可为易失性的或非易失性的。即使在不存在外部电源的情况下，例如FeRAM的非易失性存储器也可维持其所存储逻辑状态历时延长的时间周期。易失性存储器装置，例如DRAM，在与外部电源断开连接时可能丢失其所存储状态。FeRAM可能够达成类似于易失性存储器的密度，但可归因于铁电电容器被用作存储装置而具有非易失性性质。
附图说明
[0006]图1示出根据如本文所公开的实例的支持用于存储器装置的延迟校准振荡器的系统的实例。
[0007]图2示出根据如本文中所公开的实例的支持用于存储器装置的延迟校准振荡器的存储器裸片的实例。
[0008]图3A及3B示出根据如本文所公开的实例的支持用于存储器装置的延迟校准振荡器的时序链的实例。
[0009]图4示出根据如本文所公开的实例的支持用于存储器装置的延迟校准振荡器的延迟组件的实例。
[0010]图5示出根据如本文所公开的实例的支持用于存储器装置的延迟校准振荡器的延迟链的实例。
[0011]图6示出根据如本文所公开的实例的支持用于存储器装置的延迟校准振荡器的信号传播的实例。
[0012]图7展示根据如本文中所公开的实例的支持用于存储器装置的延迟校准振荡器的存储器装置的框图。
[0013]图8展示根据如本文所公开的实例的示出支持用于存储器装置的延迟校准振荡器的一或多种方法的流程图。
具体实施方式
[0014]在一些存储器装置中，存取存储器单元可涉及受相应时序信号控制的各种操作，所述时序信号可通过输入信号(例如，存取命令、存取触发器)而触发或起始。为支持根据所要相对时序执行的操作，存储器装置可包含一或多个延迟链，各自具有经配置用于根据所要时序产生时序信号的延迟组件的相应集合。通过延迟组件产生的此类时序信号可被称作异步时序信号，且可具有通过一或多个延迟组件相对于输入信号的转换而延迟的转换(例如，上升边缘、下降边缘)。
[0015]延迟组件可包含在输入信号的转换与输出信号的对应转换之间强加延迟的各种电路元件。举例来说，延迟组件可包含一或多个门延迟或门延迟组件，其可与越过阈值电压的组件的输入信号与越过阈值电压的组件的输出信号之间的持续时间相关联。延迟组件还可包含其它类型的无源或有源延迟元件，例如电阻器、电容器、电流源及其类似者。在一些实例中，延迟组件可具有对制造可变性(例如，过程可变性)或操作状况可变性(例如，电压可变性、温度可变性)敏感的时序特性，使得异步时序信号还可受此类可变性影响。在各个实例中，异步时序信号的可变性可与存储器装置的不良性能相关联，或异步时序信号的可变性可有利地用于调整在不同操作状况下的存取操作时序。因此，存储器装置可包含可经配置用于调整标称延迟持续时间，或延迟持续时间的可变性(例如，相对于温度、电压或其它参数的斜率)以及其它可配置性的延迟组件。
[0016]在一些实例中，存储器装置的延迟链可在环形振荡器配置中可操作，所述环形振荡器配置可支持延迟校准操作的各种方面。举例来说，延迟链可在校准模式中操作，在所述校准模式中环形振荡器配置经循环，且计数器用于计数在校准持续时间内环形振荡器的循环的数量。在一些实例中，环形振荡器配置可通过在延迟链的反馈回路中包含反相器而支持，使得经由延迟链的每一遍次是与上升边缘传播与下降边缘传播之间的交替相关联。因此，环形振荡器信号的循环可与在整个延迟链中的两个遍次相关联，例如对应于上升边缘传播的第一遍次及响应于所述第一遍次或以其它方式在所述第一遍次之后对应于下降边缘传播的第二遍次。然而，在一些实例中，延迟链的下降边缘延迟的方面可不同于延迟链的上升边缘延迟的方面(或反之亦然)，且可与所要时序信号产生较少相关。因此，使在此配置中的延迟链环振荡器循环可对于相对于所要存取操作时序校准延迟链具有限制。
[0017]根据如本文所公开的实例，存储器装置可包含可在包含脉冲产生器的环形振荡器配置中操作的延迟链。脉冲产生器可经配置以响应于输入信号的转换而产生具有第一转换(继之以第二转换(例如，反向转换)的输出信号，其可为响应于输入信号的转换而产生脉冲信号的实例。通过在环形振荡器的反馈回路中产生脉冲信号，环形振荡器可支持不依赖于在整个延迟链中的第一信号传播遍次及响应性反向信号传播遍次两者的循环。实际上，包含脉冲信号产生的环形振荡器配置可使用在整个延迟链中的单一信号传播遍次支持循环，所述循环可支持更接近地表示拟被校准(例如，上升边缘延迟校准)的延迟链的持续时间的
环形振荡器循环时间(例如，周期)。因此，通过在延迟链的环形振荡器配置中包含脉冲产生器，存储器装置可支持相关延迟持续时间的改进的校准。
[0018]本公开的特征最初在如参看图1到2所描述的存储器系统及裸片的内容背景中加以描述。本公开的特征是在如参看图3到6描述的存取操作时序图、延迟组件及相关电路系统以及环形振荡器信令的内容背景中加以描述。本公开的这些及其它特征是通过关于如参看图7及8描述的存储器装置的延迟校准振荡器的设备图及流程图进一步示出，且参考所述图进行描述。
[0019]图1示出根据如本文所公开的实例的支持存储器装置的延迟校准振荡器的系统100的实例。系统100可包含主机装置105、存储器装置110及耦合主机装置105与存储器装置110的多个通道115。系统100可包含一或多个存储器装置110，但一或多个存储器装置110的方面可在单一存储器装置(例如，存储器装置110)的内容背景下进行描述。
[0020]系统100可包含电子装置的部分，电子装置例如计算装置、移动计算装置、无本文档来自技高网...
【技术保护点】
【技术特征摘要】
【国外来华专利技术】1.一种设备，其包括：存储器装置的延迟链，所述延迟链包括耦合于第一节点与第二节点之间且经配置以在所述第二节点处产生相对于所述第一节点处的信号具有延迟的信号的延迟组件的集合；脉冲组件，其耦合于所述第二节点与所述第一节点之间且经配置以至少部分地基于所述第二节点处的所述信号满足阈值而在所述第一节点处的所述信号中产生脉冲；及计数器，其与所述第二节点耦合且经配置以计数所述信号的循环的数量。2.根据权利要求1所述的设备，其进一步包括：开关组件，其经配置以选择地启用或抑制至少部分地基于所述存储器装置的操作模式而在所述第一节点处的所述信号中产生所述脉冲。3.根据权利要求1所述的设备，其中延迟组件的所述集合的每一延迟组件包括用于配置相应延迟持续时间的可配置的延迟组件。4.根据权利要求1所述的设备，其中延迟组件的所述集合的至少一个延迟组件是与至少基于所述存储器装置的温度的相应延迟持续时间相关联。5.根据权利要求4所述的设备，其中延迟组件的所述集合的所述至少一个延迟组件包括用于配置所述相应延迟持续时间相对于所述存储器装置的所述温度的斜率的可配置的延迟组件。6.根据权利要求1所述的设备，其进一步包括：延迟组件的第二集合，其耦合于所述延迟链的所述第二节点与第三节点之间且经配置以在所述第三节点处产生相对于所述第二节点处的所述信号具有第二延迟的信号，其中延迟组件的所述第二集合的每一延迟组件包括用于配置相应延迟持续时间的可配置的延迟组件。7.根据权利要求1所述的设备，其中所述延迟链经配置以执行以下操作：至少部分地基于存取命令在所述第一节点处接收第二信号；及产生相对于所述第二信号具有第二延迟的存取操作时序信号，所述第二延迟至少部分地基于延迟组件的所述集合中的至少一者。8.根据权利要求7所述的设备，其中所述延迟链进一步包括耦合于所述延迟链的所述第二节点与第四节点之间的复制延迟组件，所述复制延迟组件经配置有对应于所述脉冲组件的延迟持续时间的复制延迟持续时间，且其中所述延迟链经配置以产生在所述第四节点处并具有至少部分地基于延迟组件的所述集合及所述复制延迟组件的所述第二延迟的所述存取操作时序信号。9.根据权利要求7所述的设备，其中所述延迟链经配置以产生在所述第二节点处并具有至少部分地基于延迟组件的所述集合的所述第二延迟的所述存取操作时序信号。10.根据权利要求1所述的设备，其中相对于所述第一节点处的所述信号的所述延迟是至少部分地基于延迟组件的所述集合的无源电路元件的时间常数性质。11.根据权利要求1所述的设备，其中延迟组件的所述集合中的至少一者经配置以用于第一信号转换方向的第一延迟及第二信号转换方向的不同于所述第一延迟的第二延迟。12.根据权利要求11所述的设备，其中延迟组件的所述集合中的所述至少一者经操作以分别配置所述第一延迟及所述第二延迟。13.根据权利要求1所述的设备，其中所述脉冲组件经配置以至少部分地基于所述第二
节点处的所述信号的信号转换方向在所述第一节点处的所述信号中产生所述脉冲。14.根据权利要求1所述的设备，其中所述延迟链是与第一类型的存取操作相关联，所述设备进一步包括：所述存储器装置的第二延迟链，其与第二类型的存取操作相关联，所述第二延迟链包括延迟组件的第二集合，所述第二集合耦合于第三节点与第四节点之间且经配置以在所述第四节点处产生相对于所述第三节点处的信号具有第二延迟的信号。15.根据权利要求14所述的设备，其中延迟组件的所述第二集合的每一延迟组件包括用...
【专利技术属性】
技术研发人员：赤松宏，
申请(专利权)人：美光科技公司，
类型：发明
国别省市：
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