一种基于RFSOC模组的多通道AD同步采集电路制造技术

本实用新型专利技术涉及一种基于RFSOC模组的多通道AD同步采集电路，它包括RFSOC芯片和数据同步采集通道；所述数据同步采集通道包括单模块采集通道或者多模块采集通道；所述RFSOC芯片与所述单模块采集通道或者多模块采集通道连接；单模块采集通道自身产生采样时钟信号、同步信号和CORE时钟信号实现8路ADC通道的同步采集，多模块采集通道接入外部输入的采样时钟信号、同步信号和CORE时钟信号实现8

【技术实现步骤摘要】
一种基于RFSOC模组的多通道AD同步采集电路


[0001]本技术涉及多通道数据采集
，尤其涉及一种基于RFSOC模组的多通道AD同步采集电路。

技术介绍

[0002]传统的多通道AD采样实现基本都是通过FPGA+外接ADC芯片的形式实现的，这种方式设计复杂，需要同时对PCB和电源进行复杂设计，而且对时钟的设计要求也比较高，导致整体的设计开发成本高周期长，不利于雷达、通信以及DBF(数字波束合成)等领域的应用。

技术实现思路

[0003]本技术的目的在于克服现有技术的缺点，提供一种基于RFSOC模组的多通道AD同步采集电路，解决了现有多通道AD采样方式存在的不足。
[0004]本技术的目的通过以下技术方案来实现：一种基于RFSOC模组的多通道AD同步采集电路，它包括RFSOC芯片和数据同步采集通道；所述数据同步采集通道包括单模块采集通道或者多模块采集通道；所述RFSOC芯片与所述单模块采集通道或者多模块采集通道连接；单模块采集通道自身产生采样时钟信号、同步信号和CORE时钟信号实现8路ADC通道的同步采集，多模块采集通道接入外部输入的采样时钟信号、同步信号和CORE时钟信号实现8
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n路ADC通道的同步采集，n为大于1的正整数。
[0005]所述单模块采集通道包括时钟模块、缓冲器和巴伦转换器通过SMP射频连接器将模拟信号输入到所述巴伦转换器转换为差分信号，提供给RFSOC进行AD采样，转换后的数据传输到AXI总线提供给PL端处理；所述时钟模块输出ADC需要的采样时钟信号、同步信号和CORE时钟信号，其中采样时钟信号输入到缓冲器分发后提供给RFSOC芯片内部的ADC端口作采样时钟。
[0006]所述时钟模块包括温补晶体振荡器和时钟锁相环；所述温补晶体振荡器输出10MHz的温补晶振到所述时钟锁相环，所述时钟锁相环采用内部VCO模式，输出ADC需要的采样时钟以及同步信号，经过缓冲器分发后给8路ADC采集通道提供采样时钟，以保证多路ADC之间的同步采样。
[0007]所述多模块采集通道包括多个相同的采集通道单元，每个采集通道单元包括缓冲器和巴伦转换器；通过SMP射频连接器输入外部提供同步的采样时钟信号、同步信号和CORE时钟信号，通过SMP射频连接器将模拟信号输入到所述巴伦转换器转换为差分信号后提供给RFSOC芯片采样，其中采样时钟信号输入到缓冲，经过分发后提供给RFSOC芯片内部的ADC端口作采样时钟；通过集成多个相同的采集通道单元，实现多模块多通道的同步采集。
[0008]还包括存储模块、网络接口模块和电源模块；所述存储模块和网络接口模块与所述RFSOC芯片相互连接，所述电源模块的供电输出端与所述RFSOC芯片连接。
[0009]所述存储模块包括DDR和Flash，所述DDR和Flash与所述RFSOC芯片相互连接。
[0010]本技术具有以下优点：一种基于RFSOC模组的多通道AD同步采集电路，降低了
开发周期、开发成本和开发复杂度，无需扩展ADC芯片即可完成8通道高速ADC采集和数据处理，同时支持多个模块多通道同步。设计简单、成本较低、极大的降低开发成本。在雷达、通信、DBF等应用中，有极强的竞争力。
附图说明
[0011]图1为本技术单模块采集通道时的整体原理结构示意图；
[0012]图2单模块采集通道的原理结构示意图；
[0013]图3为多模块采集通道的原理结构示意图。
具体实施方式
[0014]为使本申请实施例的目的、技术方案和优点更加清楚，下面将结合本申请实施例中附图，对本申请实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本申请一部分实施例，而不是全部的实施例。通常在此处附图中描述和示出的本申请实施例的组件可以以各种不同的配置来布置和设计。因此，以下结合附图中提供的本申请的实施例的详细描述并非旨在限制要求保护的本申请的保护范围，而是仅仅表示本申请的选定实施例。基于本申请的实施例，本领域技术人员在没有做出创造性劳动的前提下所获得的所有其他实施例，都属于本申请保护的范围。下面结合附图对本技术做进一步的描述。
[0015]如图1所示，本技术具体涉及一种基于Zynq ultrascal RFSOC的多模块多通道AD同步采集电路，以Zynq ultrascal RFSOC为核心，实现8通道AD同步采集以及多模块多通道同步采集。最大采样率4GSPS，时钟部分提供采样时钟和同步信号，数据采集转换后通过传输到RFSOC的AXI总线供PL端进行处理。
[0016]它包括RFSOC芯片和数据同步采集通道；所述数据同步采集通道包括单模块采集通道或者多模块采集通道；所述RFSOC芯片与所述单模块采集通道或者多模块采集通道连接；单模块采集通道自身产生采样时钟信号、同步信号和CORE时钟信号实现8路ADC通道的同步采集，多模块采集通道接入外部输入的采样时钟信号、同步信号和CORE时钟信号实现8
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n路ADC通道的同步采集，n为大于1的正整数。
[0017]进一步地，如图2所示，其中一种实施方式为单模块的同步采集模式，其中单模块采集通道包括时钟模块、缓冲器和巴伦转换器；通过SMP射频连接器将模拟信号输入到所述巴伦转换器转换为差分信号后提供给RFSOC芯片采样；所述时钟模块输出ADC需要的采样时钟信号、同步信号和CORE时钟信号，其中采样时钟信号输入到缓冲器，经过分发后提供给RFSOC作采样时钟。
[0018]其中，时钟模块包括温补晶体振荡器和时钟锁相环；所述温补晶体振荡器输出10MHz的温补晶振到所述时钟锁相环，所述时钟锁相环采用内部VCO(压控振荡器)模式，输出ADC需要的采样时钟以及同步信号，经过缓冲器分发后给8路ADC采集通道提供采样时钟，以保证多路ADC之间的同步采样。
[0019]进一步地，时钟PLL(时钟锁相环)选用TI的LMK04828，板上参考10MHz温补晶振。采用内部VCO模式，输出ADC需要的采样时钟，以及同步信号SYSREF。8路ADC需要4路采样时钟，LMK04828输出的时钟经过低延迟BUFFER(缓冲器)分发后提供给Zynq ultrascal RFSOC芯
片作为采样时钟，保证多路ADC之间的同步性。BUFFER典型延迟为1.5ps，保证多路ADC的同步采样。
[0020]进一步地，如图3所示，另一种实施方式为采用多模块多通道的同步采集模式，其中多模块采集通道包括多个相同的采集通道单元，每个采集通道单元包括缓冲器和巴伦转换器；通过SMP射频连接器输入外部提供同步的采样时钟信号、同步信号和CORE时钟信号，通过SMP射频连接器将模拟信号输入到所述巴伦转换器转换为差分信号后提供给RFSOC采样，其中采样时钟信号输入到缓冲缓冲器，经过分发后提供给RFSOC作采样时钟；通过集成多个相同的采集通道单元，实现多模块多通道的同步采集。
[0021]其中，多模块多通道同步，本文档来自技高网...

【技术保护点】

【技术特征摘要】
1.一种基于RFSOC模组的多通道AD同步采集电路，其特征在于：它包括RFSOC芯片和数据同步采集通道；所述数据同步采集通道包括单模块采集通道或者多模块采集通道；所述RFSOC芯片与所述单模块采集通道或者多模块采集通道连接；单模块采集通道自身产生采样时钟信号、同步信号和CORE时钟信号实现8路ADC通道的同步采集，多模块采集通道接入外部输入的采样时钟信号、同步信号和CORE时钟信号实现8
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n路ADC通道的同步采集，n为大于1的正整数。2.根据权利要求1所述的一种基于RFSOC模组的多通道AD同步采集电路，其特征在于：所述单模块采集通道包括时钟模块、缓冲器和巴伦转换器；通过SMP射频连接器将模拟信号输入到所述巴伦转换器转换为差分信号，提供给RFSOC芯片进行AD采样，转换后的数据传输到AXI总线提供给PL端处理；所述时钟模块输出ADC需要的采样时钟信号、同步信号和CORE时钟信号，其中采样时钟信号输入到缓冲器，经过分发后提供给RFSOC芯片内部的ADC端口进行AD同步采集。3.根据权利要求2所述的一种基于RFSOC模组的多通道AD同步采集电路，其特征在于：所述时钟模块包括温补晶体振荡器和时钟锁相环；所述温补晶体振荡器输出10MHz的温补晶振到所述时钟锁相环，所述时钟锁相环采用内部VCO模...

【专利技术属性】
技术研发人员：冯金，陈元春，
申请(专利权)人：四川特伦特科技股份有限公司，
类型：新型
国别省市：