形成半导体器件槽隔离的方法技术

一种形成槽隔离的方法包括在半导体衬底上依次形成垫氧化层和有源氮化层。通过腐蚀氮化层和垫氧化层形成槽掩模层。通过使用槽掩模层作掩模腐蚀半导体衬底以形成槽。在槽的底和两侧壁上形成氮化层。在氧化层上形成氧化掩模层，例如氮化物衬垫。淀积槽隔离层足以填满槽。通过使用平面化腐蚀除去槽隔离层直到氮化物衬垫的上表面暴露为止。进行离子注入或等离子体处理以破坏有源氮化层但不破坏衬底。除去槽隔离层直到半导体衬底上表面暴露为止。（*该技术在2018年保护过期，可自由使用*）

【技术实现步骤摘要】

本专利技术涉及制造半导体器件的方法，特别涉及形成槽隔离的方法。随着促进高密度DRAM的增加，器件隔离的方法已从常规的LOCOS(局部硅氧化)技术变为STI(浅槽隔离(Shallow trench isolation))技术。但是，在STI方法时，槽内壁中的氧化层的膨胀在槽中和有源区中产生浅坑(pit)。结果，半导体衬底的有源区中的漏电流增加。为解决上面问题，氮化物衬垫(liner)已用作氧化掩模层，用于防止槽内壁在后续工艺中被氧化。通过使用氮化物衬垫，可以防止浅坑。但是，在利用磷酸进行的有源氮化层的腐蚀过程中氮化物衬垫被腐蚀到半导体衬底表面下面的一点(即氮化物衬垫向下凹陷)。这样，凹陷的氮化物衬垫使在腐蚀栅极(gate poly)的后续工艺中产生纵梁式残余物(stringer residual)。为解决上述问题，现有技术，例如US专利号5447884展示了带有小于50埃的衬垫厚度的氮化物衬垫的浅槽隔离。上述方法包括以下步骤在半导体衬底上沉积含有至少一层氮化物的保护层；腐蚀透保护层，以形成一组隔离掩模孔；穿过该组隔离掩模孔腐蚀，以形成一组隔离槽；淀积厚度小于50埃的氮化物保角(conformal)衬垫；淀积厚度足以填满该组隔离槽的氧化物CVD层；去掉隔离槽外面的氧化物CVD层部分，从而暴露至少一层氮化物；在磷酸中剥离至少一层氮化区。根据上面的方法，通过使用很薄的氮化物衬垫作为氧化掩模层防止了保角氮化物衬垫的凹陷。但是，保角氮化物衬垫太薄，不能防止槽内壁被氧化。因此，需要一种方法，它不仅能防止氮化物衬垫凹陷，又能防止槽内壁被氧化。本专利技术用于解决上述问题，本专利技术的目的是防止在腐蚀有源氮化层过程中氮化物衬垫凹陷。本专利技术又一目的是缩短有源氮化层的剥离时间。本专利技术另一目的是提供半导体衬底中的浅槽隔离。根据本专利技术，形成槽隔离的方法包括在半导体衬底上形成垫氧化层(pad Otide layer)和有源氮化层；通过腐蚀半导体衬底形成确定槽形成区域的槽掩模层；使用槽掩模层作为掩模腐蚀半导体衬底，以形成槽。在槽底和两侧壁上形成氧化层，以消除在腐蚀半导体衬底步骤过程中产生的衬底损坏；在包括有源氮化层的槽上形成氧化掩模层，例如，氮化物衬垫，以便防止槽的底和两侧壁被氧化；淀积槽隔离层足以充满槽；进行退火工艺以致密化槽隔离层；去掉槽隔离层，直到暴露氮化物衬垫的上表面为止；在有源氮化层上进行离子注入或等离子体工艺；使用磷酸平面腐蚀槽掩模层，直到暴露半导体衬底的上表面为止。根据本专利技术，在剥离之前破坏有源氮化层，使有源氮化层的剥离时间缩短成为可能，由此防止氮化物衬垫凹陷。参照附图可以理解本专利技术，并且对本领域技术人员来说其目的将更明显，其中图1—图7是根据本专利技术的优选实施例形成槽隔的新方法。下面参照附图说明本专利技术优选实施例。图1—图7是表示根据本专利技术优选实施例形成槽隔的新方法的各个阶段的剖面图。如图1所示，根据本专利技术优选实施例，在半导体衬底200上依次形成垫氧化层202和有源氮化层202b。通过已知光刻方法形成确定槽形成区域的槽掩模层202。此后，利用槽掩模层202作为掩模腐蚀半导体衬底，以形成槽203。参见图2，在槽203的底和两侧壁上形成氧化层204，以除去由腐蚀半导体衬底200的步骤引起的硅晶格中的缺陷。氧化层例如是二氧化硅(SiO2)。参见图3，利用LPCVD在包括槽203的有源氮化层202b上形成氧化掩模层，例如氮化物村垫205，以防止槽内壁被氧化。氮化物衬垫205是由，例如氮化硅(Si3N4)形成。所形成的氮化物衬垫205厚度约为300埃到600埃，足以防止氧化。参见图4，淀积槽隔离层206，例如USG(O3TEOS)层，以填满槽203。此后，进行退火工艺以致密化槽隔离层206。参见图5，使用平面化腐蚀，例如CMP工艺除去槽隔离层206，直到氮化物衬垫205的上表面暴露为止。参见图6，为了削弱有源氮化层202b的Si-N键合力而不破坏半导体衬底200，在有源氮化层205上进行离子注入或等离子体工艺。由于此离子注入或等离子体工艺，缩短了有源氮化层202b的剥离时间。上面的离子注入是通过以剂量范围约从1×1010cm-2到1×1017cm-2、加速能范围约从10kev到100kev注入选自下列的一种离子进行的P、As、B、Ar和Si。另一方面，上面的等离子体工艺是通过以功率范围约从10W到5000W、气压范围约从1×10-4乇以700乇使用选自下列的一种离子进行的Xe、Kr和Ar。如图7所示，通过使用磷酸腐蚀槽掩模层202直到半导体衬底200的表面暴露为止，从而形成槽隔离208。根据本专利技术，在剥离有源氮化层之前在有源氮化层上进行破坏有源氮化层工艺，例如离子注入工艺或等离子体工艺。这样，由于削弱了有源氮化层中Si-N键合力而缩短了有源氮化层的剥离时间。因而，可以避免氮化物衬垫的凹陷现象，并提高了槽的隔离特性。本文档来自技高网...

【技术保护点】
一种在半导体器件中形成槽隔离的方法，包括以下步骤：在半导体衬底上依次形成垫氧化层和有源氮化层；通过腐蚀所述有源氮化层和垫氧化层形成槽掩模层，所述槽掩模层确定槽形成区域；使用槽掩模层作为掩模，腐蚀所述半导体衬底以形成槽；在所述 槽的底和两侧壁上形成氧化层以除去在腐蚀所述半导体衬底的所述步骤过程中产生的衬底损坏；在包括所述有源氮化物衬垫的所述槽上形成氮化物衬垫，以防止所述槽的底和两侧壁被氧化；淀积槽隔离层以填满所述槽；进行退火工艺以致密化所述槽隔离层； 通过平面腐蚀去掉所述槽隔离层，直到所述氮化物衬垫暴露为止；破坏所述有源氮化层以消弱Ｓｉ－Ｎ键合力；剥离所述槽掩模层直到所述半导体衬底上表面暴露为止。

【技术特征摘要】
KR 1998-6-16 22584/981. 一种在半导体器件中形成槽隔离的方法，包括以下步骤在半导体衬底上依次形成垫氧化层和有源氮化层；通过腐蚀所述有源氮化层和垫氧化层形成槽掩模层，所述槽掩模层确定槽形成区域；使用槽掩模层作为掩模，腐蚀所述半导体衬底以形成槽；在所述槽的底和两侧壁上形成氧化层以除去在腐蚀所述半导体衬底的所述步骤过程中产生的衬底损坏；在包括所述有源氮化物衬垫的所述槽上形成氮化物衬垫，以防止所述槽的底和两侧壁被氧化；淀积槽隔离层以填满所述槽；进行退火工艺以致密化所述槽隔离层；通过平面腐蚀去掉所述槽隔离层，直到所述氮化物衬垫暴露为止；破坏所述有源氮化层以消弱Si-N键合力；剥离所述槽掩模层直到所述半导体衬底上表面暴露为止。2. 如权利要求1的方法，其中破...

【专利技术属性】
技术研发人员：黄铉，南硕佑，
申请(专利权)人：三星电子株式会社，
类型：发明
国别省市：KR[韩国]