【技术实现步骤摘要】
数据处理装置及数据处理方法
[0001]本申请涉及数据处理
,尤其涉及一种数据处理装置及数据处理方法。
技术介绍
[0002]多数据算术运算的数据模型具备数据多、位宽大、吞吐量高的特点,通常需要对多个数据进行灵活复杂的算术运算。数据模型中的运算大多为数据之间或者数据与常数之间的乘法、加法、减法,以及数据的自身共轭等基本运算。
[0003]MIMD(Multiple Instruction Multiple Data,多指令多数据)处理装置,可以对多个输入数据进行复杂算术运算,其中,在MIMD处理装置中多个运算单元之间采用的互联路由方式通常为矩阵互联、共享总线或者全映射路由等。但是,在矩阵互联方式中,存在用于路由而无法实际运算的运算单元,会造成运算单元运算效率的浪费;在共享总线方式中,不能多个运算单元同时传输数据,运算单元之间的数据传输效率较低,以此降低了完成运算的速度;在全映射路由方式中,运算单元之间的连线开销以及选择器开销都比较大。因此,上述互联路由方式无法实现运算单元运算效率、数据传输效率和互联开销的平衡。
技术实现思路
[0004]本申请实施例提供了一种数据处理装置及数据处理方法,以实现在对多个输入数据进行复杂算术运算时兼顾运算单元运算效率、数据传输效率和互联开销的平衡。
[0005]第一方面,本申请实施例提供了一种数据处理装置,包括:配置模块、输入路由模块、互联路由模块和多个乘加单元(Multiply and Accumulate Unit,MAU)模块,其中,
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【技术保护点】
【技术特征摘要】
1.一种数据处理装置,其特征在于,包括:配置模块、输入路由模块、互联路由模块和多个乘加单元模块,其中,所述配置模块,用于根据输入数学模型分别对所述输入路由模块、所述互联路由模块以及所述多个乘加单元模块进行配置,对应得到第一配置数据、第二配置数据和第三配置数据;所述输入路由模块,用于根据所述第一配置数据,建立所述数据处理装置的多个输入数据通道到所述多个乘加单元模块的输入接口之间的输入路由;所述互联路由模块,用于根据所述第二配置数据,按照所述多个乘加单元模块的编号排序位数建立所述多个乘加单元模块中前级乘加单元模块的输出接口到后级乘加单元模块的输入接口之间的互联路由,以实现所述多个乘加单元模块之间的单向级联;所述乘加单元模块,用于通过所述输入路由和/或所述互联路由获取所述乘加单元模块的输入数据,并根据所述第三配置数据对所述乘加单元模块的输入数据进行算术运算。2.根据权利要求1所述的装置,其特征在于,所述乘加单元模块的输入接口包括:两个装置数据输入接口,用于接收所述数据处理装置的输入数据;所述乘加单元模块的输入接口包括:两个互联数据输入接口,用于接收前级乘加单元模块的输出数据;所述乘加单元模块的输入接口还包括:常数输入接口,用于接收所述配置模块配置的常数;所述乘加单元模块,用于根据所述第三配置数据,在通过所述输入接口接收的数据中选择一个或两个数据进行算术运算。3.根据权利要求2所述的装置,其特征在于,所述互联路由模块用于通过直连方式和/或选择器提供前级乘加单元模块的输出接口到后级乘加单元模块的互联数据输入接口之间的互联路由;其中,所述前级乘加单元模块的编号排序位数小于所述后级乘加单元模块的编号排序位数。4.根据权利要求3所述的装置,其特征在于,针对编号排序前四位的乘加单元模块,所述互联路由模块用于通过直连方式提供前级乘加单元模块的输出接口到后级乘加单元模块的互联数据输入接口之间的互联路由;针对除编号排序前四位之外的乘加单元模块,所述互联路由模块用于通过直连方式和选择器提供前级乘加单元模块的输出接口到后级乘加单元模块的互联数据输入接口之间的互联路由。5.根据权利要求4所述的装置,其特征在于,针对编号排序前四位的乘加单元模块,所述互联路由模块用于通过直连方式提供前级乘加单元模块的输出接口到后级乘加单元模块的互联数据输入接口之间的互联路由,包括:所述互联路由模块,用于通过直连方式提供第1位乘加单元模块的输出接口到第2位乘加单元模块的互联数据输入接口之间的互联路由,第1位乘加单元模块的输出接口和第2位乘加单元模块的输出接口到第3位乘加单元模块的互联数据输入接口之间的互联路由,第2位乘加单元模块的输出接口和第3位乘加单元模块的输出接口到第4位乘加单元模块的互联数据输入接口之间的互联路由。6.根据权利要求4所述的装置,其特征在于,针对除编号排序前四位之外的乘加单元模
块,所述互联路由模块用于通过直连方式和选择器提供前级乘加单元模块的输出接口到后级乘加单元模...
【专利技术属性】
技术研发人员:刘欢,冯立国,
申请(专利权)人:深圳市中兴微电子技术有限公司,
类型:发明
国别省市:
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