The present invention relates to an automatic error detection method for high-speed interconnected interface. In this method, if the interconnection is successful, the interconnection of high-speed interface is successful. If it is not successful, it will continue to connect the high-speed interface successfully. If the high-speed interconnection interface is successful, the data received by the design module is sent to the receiving statistical module, then the data is sent to the receiving statistics module. At the same time, the data is sent to the statistics module. At the same time, the data is sent to the sending statistics module, and the statistics module is sent to the statistics module. If the data comparison is needed, the design module needs to be compared with the I2C interface. If the return module receives the command that needs to be compared with the data. Then the return module will send the number of data and the number of data received, through the selection of the data selection module, through the high-speed interface module to the opposite FPGA. After the return module receives the pre set return number, the comparison result is given to the data number comparison, the invention does not need to change the original hardware set. Under the premise of the plan, an automatic error detection mechanism of high speed interconnected interface is given, which reduces the manual participation, accelerates the debugging process, and greatly shortens the FPGA prototype verification cycle and the chip R & D cycle.
【技术实现步骤摘要】
一种高速互联接口的自动化检错机制
本专利技术涉及服务器互联芯片的FPGA原型验证领域,特别涉及一种高速互联接口的自动化检错方法。
技术介绍
随着日常生活中的业务越来越多,越来越复杂,对服务器的性能要求也越来越高,为提供服务器的性能,单靠提高单个CPU节点的性能已经无法满足人们对服务器性能的要求,因此需要提高服务器中CPU的路数来提高性能。服务器互联芯片(CC芯片)是多路处理器共享主存系统的核心芯片,其主要功能是维护全局cache一致性,并实现全局IO共享和全系统中断。为使系统具有良好的实用性能,要求大规模共享存储应用程序(如Oracle数据库)的总体性能随着系统规模的增长而近似线性增长。随着芯片设计规模的与日俱增,其功能日趋复杂,芯片的验证阶段占据了整个芯片开发的大部分时间。为了缩短验证时间,在传统的仿真验证的基础上涌现了许多新的验证手段,如SDV(SoftwareDrivenverification)、BFM(BusFunctionModel)等,以及基于FPGA的原型验证技术。由于FPGA的优势,大多芯片的开发采用FPGA原型验证技术。在芯片FPGA原型验证过程中,由于芯片设计规模的与日俱增,无法将芯片整个设计移植到单片FPGA芯片中去,因此比较将设计进行合理的切割,分别移植到各个FPGA芯片中去。FPGA芯片之间通过高速互联接口进行互联,在互联芯片FPGA原型验证过程中,进行系统调试过程中,问题极难定位的现状,本专利技术在不需要更改原先的硬件设计的前提下,给出了一种高速互联接口的自动化检错机制,减少了人工的参与,加快了调试进程,大大缩短了FPGA原型 ...
【技术保护点】
一种通过高速接口互联的系统,其特征在于:该系统包括了多个芯片,芯片内包括了高速接口,芯片间通过高速接口互联。
【技术特征摘要】
1.一种通过高速接口互联的系统,其特征在于:该系统包括了多个芯片,芯片内包括了高速接口,芯片间通过高速接口互联。2.根据权利要求1所述的系统,其特征在于:每个芯片都还包括了设计模块、数据选择模块、接收统计模块、回传模块、发送统计模块。3.根据权利要求1-2任一项所述的系统,其特征在于:高速接口包括了发送模块、接收模块。4.根据权利要求1-2任一项所述的系统,其特征在于:其中,高速接口为Xilinx的高速接口Aurora。5.根据权利要求1-2任一项所述的系统,其特征在于:芯片为FPGA芯片。6.一种根据权利要求1-5任一项所述的系统的高速接口自动化检错方法,其特征在于:...
【专利技术属性】
技术研发人员:周玉龙,刘同强,刘刚,邹晓峰,
申请(专利权)人:郑州云海信息技术有限公司,
类型:发明
国别省市:河南,41
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