A system and method with two or more secure digital input output (SDIO) a security unit digital input and output unit of communication, in the a secure digital input and output unit is addressed when only one SDIO cell response, the SDIO unit has a SDIO clock input port and SDiO data bus the output port and SDIO bidirectional command port. Each SDIO unit has an address indicator associated with each SDIO unit. Unless the SDIO cell address encoded in the SDIO command matches the address indicator of the SDIO unit, the SDIO unit will not respond to the SDIO command. In some configurations, a single multiple SDIO (MSDIO) command allows two or more SDIO units to return data to the host.
【技术实现步骤摘要】
【国外来华专利技术】具有多个SDIO单元的多址单SDIO接口
概括地说,本专利技术的各个配置涉及传送数字数据的装置、系统和方法。具体地说,该装置、系统和方法涉及共享公共数据接口的若干设备。尤其是,该装置、系统和方法提供在单个SDIO主机和若干SDIO设备之间发送和接收安全数字输入/输出(SDIO)命令。
技术介绍
安全数字(SD)标准是在1999年八月作为多媒体卡(MMC)上的改进而引入的。安全数字标准是由SD协会(SDA)来维护的。SD技术已经在数百个品牌中,跨越数十个产品类别以及在数千个电子设备中实现。SD通常用在非易失性存储卡中。这些存储卡被广泛地用于便携设备中,比如移动电话、数码相机、GPS导航设备、掌上游戏机和平板计算机。该安全数字格式包括在三种不同形状因素中可用的四种卡系列。该四个系列是原始标准容量(SDSC)、高容量(SDHC)、扩展容量(SDXC)和SDIO,所述SDIO将输入/输出功能与数据存储结合起来。除了SDIO的情况之外,这些标准可以以三个形状因素来实现:原始大小、小型大小和微大小。电气无源适配器允许较小的卡装入针对较大的卡构建的设备中并且在其中起作用。安全数字输入输出接口标准是用于涵盖I/O功能的对SD规范的较新的扩展。SDIO标准化接口具有较低的引脚计数。SDIO卡只在被设计用于支持它们的输入/输出功能的主机设备(典型的是个人数字助理(PDA),但是偶尔是膝上型计算机或移动电话)中完全起作用。这些设备可以使用SD槽来支持全球定位系统(GPS)接收机、调制解调器、条形码读码器、FM无线调谐器、TV调谐器、射频识别(RFID)读取器、数码相机和到Wi- ...
【技术保护点】
一种安全数字输入/输出(SDIO)系统,包括:适用于连接到主机的单SDIO接口;连接到所述SDIO接口的单SDIO总线;连接到所述SDIO总线的第一SDIO单元;连接到所述SDIO总线的第二RSDIO单元;其中,所述第一SDIO单元和所述第二SDIO被配置为从所述主机接收单个多SDIO(MSDIO)命令,所述单个多SDIO(MSDIO)命令要求所述第一SDIO单元和所述第二SDIO单元二者都使用所述单SDIO总线来向所述主机发送回数据;以及所述第一SDIO单元中的第一仲裁逻辑;所述第一SDIO单元中的第二仲裁逻辑,其中,所述第一仲裁逻辑和所述第二仲裁逻辑被配置为确定所述第一SDIO单元何时对所述单SDIO总线进行访问以及所述第二SDIO单元何时对所述单SDIO总线进行访问,以避免所述单SDIO总线上的干扰。
【技术特征摘要】
【国外来华专利技术】2015.06.22 US 14/746,2451.一种安全数字输入/输出(SDIO)系统,包括:适用于连接到主机的单SDIO接口;连接到所述SDIO接口的单SDIO总线;连接到所述SDIO总线的第一SDIO单元;连接到所述SDIO总线的第二RSDIO单元;其中,所述第一SDIO单元和所述第二SDIO被配置为从所述主机接收单个多SDIO(MSDIO)命令,所述单个多SDIO(MSDIO)命令要求所述第一SDIO单元和所述第二SDIO单元二者都使用所述单SDIO总线来向所述主机发送回数据;以及所述第一SDIO单元中的第一仲裁逻辑;所述第一SDIO单元中的第二仲裁逻辑,其中,所述第一仲裁逻辑和所述第二仲裁逻辑被配置为确定所述第一SDIO单元何时对所述单SDIO总线进行访问以及所述第二SDIO单元何时对所述单SDIO总线进行访问,以避免所述单SDIO总线上的干扰。2.根据权利要求1所述的SDIO系统,其中,所述单个MSDIO命令是SDIOCMD53命令。3.根据权利要求1所述的SDIO系统,其中,所述主机不知道所述单个MSDIO命令要使所述第一SDIO单元和所述第二SDIO单元二者都向所述主机发送数据。4.根据权利要求1所述的SDIO系统,其中,所述第一仲裁逻辑还包括:有限状态机(FSM),其被配置为至少部分地确定所述第一SDIO单元何时对所述单SDIO总线进行访问以及所述第二SDIO单元何时对所述单SDIO总线进行访问。5.根据权利要求3所述的SDIO系统,其中,所述第一仲裁逻辑还包括:软件(SW)驱动器,其被配置为与所述FSM相协调以确定对所述SDIO总线的仲裁。6.根据权利要求1所述的SDIO系统,其中,所述第一仲裁逻辑和所述第二仲裁逻辑是完全相同的。7.根据权利要求1所述的SDIO系统,其中,在没有主机干预或对所述单SDIO总线的所述仲裁的了解的情况下,所述第一仲裁逻辑和所述第二仲裁逻辑对所述单SDIO总线进行仲裁。8.根据权利要求1所述的SDIO系统,其中,所述第一仲裁逻辑被配置为至少部分地基于所述第一SDIO单元中可用的数据量和所述第二SDIO单元中可用的数据量,来访问所述单SDIO总线。9.根据权利要求1所述的SDIO系统,其中,所述第一SDIO单元被配置为构建具有帧...
【专利技术属性】
技术研发人员:K·里斯,V·司徒,G·胡姆,
申请(专利权)人:高通技术国际有限公司,
类型:发明
国别省市:英国,GB
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