A circuit in the charging of the capacitor to drive the power supply switch in DC voltage supply terminals and bootstrap between terminals provide high voltage and low voltage drop type diode conduction path, the output terminal of the capacitor is arranged alternately can switch between low voltage and high voltage DC voltage between terminals and bootstrap. In an embodiment, the circuit includes a first transistor and a second transistor, such as LDMOS depletion transistor, the first transistor is arranged on a common source between the terminal and the DC terminal voltage supply for the cascade arrangement, the second transistor and the sensing voltage comparator senses a voltage comparator coupled to the bootstrap terminal with the DC the supply voltage at terminals of comparison. The first transistor and the second transistor have a common control terminal coupled to the DC voltage supply terminal and a common coupling terminal coupled to the bootstrap terminal.
【技术实现步骤摘要】
驱动电路、对应的集成电路和器件
本说明书涉及驱动电路。一个或多个实施例可以涉及用于例如在高电压半桥开关电路中使用的驱动电路。
技术介绍
高电压(HV)半桥开关电路可以用在各种应用中,诸如例如电机驱动、用于荧光灯的电子镇流器和供应。这样的半桥电路可以采用跨HV电轨DC电压供应放置的成对的图腾式连接的开关元件(例如功率MOSFET、IGBT、FET和GaN器件)。鉴于各种可能的应用,寻求一种驱动电路的持续改进。
技术实现思路
一个或多个实施例涉及具有以下公开内容中给出的特征的驱动电路。一个或多个实施例还可以涉及对应的集成电路以及对应的器件(例如高电压半桥开关电路)。权利要求形成本文中提供的一个或多个实施例的公开内容的组成部分。一个或多个实施例可以包括用于借助于例如集成的高电压耗尽晶体管实现电容充电的电路,晶体管被控制为用作高电压和超低(前向)电压降二极管。一个或多个实施例可以包括MOS耗尽晶体管(诸如例如横向扩散的金属氧化物半导体或LDMOS)作为这类晶体管。在一个或多个实施例中,这类晶体管可以集成在隔离阱口袋中,该隔离阱口袋在高电压供应与集成电路接地电势之间维持高电压应力。在一个或多个实施例中,等同的自举(bootstrap)二极管电路可以包括第一(例如高电压LDMOS耗尽)晶体管和第二(例如高电压LDMOS耗尽)晶体管,第一晶体管可以用作高电压共源共栅器件,第二晶体管可以用作用于低电压感测比较器的区耦合晶体管,两个晶体管具有公共的漏极、本体和栅极,但是具有不同的源极端子。在一个或多个实施例中,晶体管漏极可以与高侧供应节点耦合,而栅极可以直接与低侧供应节点耦合; ...
【技术保护点】
一种电路,包括:第一晶体管和第二晶体管,其中所述第一晶体管被设置在自举端子与DC电压供应端子之间的共源共栅布置中,并且所述第二晶体管被耦合在所述自举端子与感测比较器之间,其中所述感测比较器被设置在所述第二晶体管与所述DC电压供应端子之间;所述第一晶体管和所述第二晶体管具有与所述DC电压供应端子耦合的公共控制端子以及耦合至所述自举端子的公共耦合端子;以及其中所述第一晶体管和所述第二晶体管组合操作以在对供应电容器充电以驱动功率开关时在所述DC电压供应端子与所述自举端子之间提供高电压低压降的类二极管传导路径,其中所述供应电容器被设置在所述自举端子与输出端子之间,所述输出端子在低电压DC电压与高电压DC电压之间交替地可切换。
【技术特征摘要】
2015.11.18 IT 1020150000738521.一种电路,包括:第一晶体管和第二晶体管,其中所述第一晶体管被设置在自举端子与DC电压供应端子之间的共源共栅布置中,并且所述第二晶体管被耦合在所述自举端子与感测比较器之间,其中所述感测比较器被设置在所述第二晶体管与所述DC电压供应端子之间;所述第一晶体管和所述第二晶体管具有与所述DC电压供应端子耦合的公共控制端子以及耦合至所述自举端子的公共耦合端子;以及其中所述第一晶体管和所述第二晶体管组合操作以在对供应电容器充电以驱动功率开关时在所述DC电压供应端子与所述自举端子之间提供高电压低压降的类二极管传导路径,其中所述供应电容器被设置在所述自举端子与输出端子之间,所述输出端子在低电压DC电压与高电压DC电压之间交替地可切换。2.根据权利要求1所述的驱动电路,其中所述第一晶体管和所述第二晶体管具有公共的本体。3.根据权利要求1所述的驱动电路,其中所述第一晶体管具有经由开关与所述DC电压供应端子耦合的电流源端子,当耦合至所述自举端子的所述第一晶体管的端子与所述DC电压供应端子相比为低时,所述开关可激活。4.根据权利要求3所述的驱动电路,包括所述比较器,所述比较器被配置用于经由所述第二晶体管将所述自举端子处的电压与所述DC电压供应端子处的电压相比较并且根据所述比较激活所述开关。5.根据权利要求1所述的驱动电路,其中所述第一晶体管和所述第二晶体管包括耗尽晶体管。6.根据权利要求1所述的驱动电路,其中所述第一晶体管和所述第二晶体管包括MOS晶体管。7.根据权利要求6所述的驱动电路,其中所述MOS晶体管中的每个MOS晶体管包括LDMOS晶体管。8.根据权利要求6所述的驱动电路,其中所述第一晶体管和所述第二晶体管的本体与本体极化电路耦合,以抵消所述本体极化电路中的本征双极型晶体管的接通。9.一种集成半导体电路,包括:耦合在自举节点与输出节点之间的供应电容器,所述输出节点在低电压与高电压之间交替地可切换;驱动电路,耦合至供应电压节点和所述自举节点并且被配置成对所述供应电容器充电,所述驱动电路包括:具有耦合在所述自举节点与所述供应电压节点之间的信号节点的第一晶体管,所述第一晶体管具有耦合至所述供应电压节点的控制节点;具有耦合在所述自举节点与感测节点之间的信号节点的第二晶体管,所述第二晶体管具有耦合至所述供应电压节点的控制节点;具有耦合至所述感测节点的第一输入以及耦合至所述供应电压节点的第二输入的感测比较器;以及隔离阱口袋,其中所述驱动电路的所述第一晶体管和所述第二晶体管被集成在所述隔离阱口袋中。10.根据权利要求8所述的集成半导体电路,其中所述感测比较器包括:被耦合作为共栅差分对的第一差分晶体管和第二差分晶...
【专利技术属性】
技术研发人员:G·卡格吉,F·普尔维伦蒂,G·坎通,V·帕鲁姆博,
申请(专利权)人:意法半导体股份有限公司,
类型:发明
国别省市:意大利,IT
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