本发明专利技术公开了一种寄存器组与存储器数据双向传输结构,包括:外部寄存器访问控制器通过地址总线访问寄存器组,通过控制总线与寄存器组相互通讯;数据总线开关与外部寄存器访问控制器和寄存器组相互通讯;寄存器组具有传输控制寄存器对数据开关进行传输控制;寄存器组具有算法选择寄存器对数据运算模块进行算法控制;算法模块接收存储器输出到寄存器的原始数据经过运算后传送至数据总线开关,接收数据总线开关发送来的寄存器输出到存储器的原始数据经过运算后传送至存储器。本发明专利技术还公开了一种寄存器组与存储器数据双向传输方法。本发明专利技术能实现任意数据传输路径、数据传输时间和数据传输顺序,具有更广泛的通用性和扩展性。
【技术实现步骤摘要】
寄存器组与存储器数据双向传输结构及数据双向传输方法
本专利技术涉及集成电路制造领域,特别是涉及一种寄存器组与存储器数据双向传输结构,本专利技术还涉及一种寄存器组与存储器数据双向传输方法
技术介绍
图1所示,通常的数据传输结构由外部寄存器访问控制模块、寄存器组模块、数据运算模块1~N及固定的数据传输控制模块及存储器构成。从存储器读出的数据在固定数据传输控制模块控制下送到被选中的数据运算模块X进行运算,运算结果通过数据线X送到寄存器X。这就是存储器数据到寄存器的数据传输过程。对存储器到不同的寄存器需要不同的数据运算模块。从寄存器到存储器的数据传输过程为:寄存器数据在固定的数据传输控制模块的控制下经过对应的数据运算模块运算,运算结果输出到存储器的数据总线。这种方法的缺点是:1)不同的寄存器具有不同的数据运算模块,需采用独立的数据传输通道;2)寄存器和存储器之间的数据传输的类型及数量相对固定,不能随意变动;3)外部不能对已固定的数据传输包括方向对传输对象进行变动;4)不利于功能扩展。当有新的寄存器增加时,则电路也必须相应增加控制信号、数据运算模块、及数据传输通道。
技术实现思路
本专利技术要解决的技术问题是提供一种能实现任意数据传输路径、数据传输时间和数据传输顺序,扩展方便的寄存器组与存储器数据双向传输结构。本专利技术还提供了一种寄存器组与存储器数据双向传输方法。为解决上述技术问题,本专利技术的寄存器组与存储器数据双向传输结构,包括:外部寄存器访问控制器通过地址总线访问寄存器组,通过控制总线与寄存器组相互通讯;数据总线开关与外部寄存器访问控制器和寄存器组相互通讯;寄存器组具有传输控制寄存器对数据开关进行传输控制;寄存器组具有算法选择寄存器对数据运算模块进行算法控制;算法模块,接收存储器输出到寄存器的原始数据经过运算后传送至数据总线开关,接收数据总线开关发送来的寄存器输出到存储器的原始数据经过运算后传送至存储器。一种寄存器组与存储器数据双向传输方法,适用于采用地址/数据/控制总线访问的寄存器组与存储器,能实现2N-2个寄存器与存储器之间的数据传输,N为寄存器地址线位宽,包括:寄存器设置有两种访问模式,一种模式是寄存器正常读写模式,当外部寄存器访问控制器对寄存器组中的某一寄存器进行读写时,数据在外部寄存器与寄存器之间进行传输,对寄存器进行读写操作;另一种模式是寄存器与存储器之间的数据传输模式,外部寄存器访问控制器控制寄存器对寄存器组中某一寄存器进行读写操作时,执行的是被控制的寄存器与存储器之间的数据传输;寄存器到存储器的数据传输:在寄存器与存储器之间的数据传输模式下,当对某一寄存器进行读操作时,在数据读出的同时,读出数据通过寄存器数据总线开关被送到数据运算模块,算法选择寄存器选择数据运算模块中的一种算法对数据进行处理后,再送到存储器的数据总线上;存储器到寄存器的数据传输:在寄存器与存储器之间的数据传输模式下,当外部寄存器访问控制器对寄存器组中的某一寄存器进行写操作时,数据写入无效,而执行存储器数据到被控制的寄存器的传输,此时,存储器数据通过数据运算模块处理后,再经过寄存器数据开关送到该寄存器,写入该寄存器。本方法传输控制寄存器用于控制寄存器访问模式。当该寄存器及该寄存器的输出信号值为0时,外部寄存器对寄存器组进行正常的读写访问。当该寄存器值为1时,当外部寄存器控制器对寄存器进行读操作时,将执行寄存器到存储器的数据传输。当外部寄存器控制器对寄存器进行写操作时,将执行存储器到寄存器的数据传输。数据运算模块能实现所有已知的要求的算法,数据算法选择寄存器选择其中一种算法对数据进行处理。需要传输的数据经过该运算后送到传输目标。传输控制寄存器和数据运算选择寄存器都能通过外部寄存器访问进行设置和控制能通过选择对任何寄存器进行任何存在的算法处理。本专利技术寄存器组与存储器数据双向传输方法能实现数据运算类型、数据传输方向、数据传输目标的灵活处理,能实现任意的数据传输路径、数据传输时间和数据传输顺序的控制,具有更广泛的通用性和扩展性。附图说明下面结合附图与具体实施方式对本专利技术作进一步详细的说明:图1是一种现有寄存器组与存储器数据传输结构示意图。图2是本专利技术寄存器组与存储器数据双向传输结构的结构示意图。具体实施方式如图2所示,本专利技术的寄存器组与存储器数据双向传输结构,包括:外部寄存器访问控制器通过地址总线访问寄存器组,通过控制总线与寄存器组相互通讯;数据总线开关与外部寄存器访问控制器和寄存器组相互通讯;寄存器组具有传输控制寄存器对数据开关进行传输控制;寄存器组具有算法选择寄存器对数据运算模块进行算法控制;算法模块,接收存储器输出到寄存器的原始数据经过运算后传送至数据总线开关,接收数据总线开关发送来的寄存器输出到存储器的原始数据经过运算后传送至存储器。一种寄存器组与存储器数据双向传输方法,适用于采用地址/数据/控制总线访问的寄存器组与存储器,能实现2N-2个寄存器与存储器之间的数据传输,N为寄存器地址线位宽,包括:寄存器设置有两种访问模式,一种模式是寄存器正常读写模式,当外部寄存器访问控制器对寄存器组中的某一寄存器进行读写时,数据在外部寄存器与寄存器之间进行传输,对寄存器进行读写操作;另一种模式是寄存器与存储器之间的数据传输模式,外部寄存器访问控制器控制寄存器对寄存器组中某一寄存器进行读写操作时,执行的是被控制的寄存器与存储器之间的数据传输;寄存器到存储器的数据传输:在寄存器与存储器之间的数据传输模式下,当对某一寄存器进行读操作时,在数据读出的同时,读出数据通过寄存器数据总线开关被送到数据运算模块,算法选择寄存器选择数据运算模块中的一种算法对数据进行处理后,再送到存储器的数据总线上;存储器到寄存器的数据传输:在寄存器与存储器之间的数据传输模式下,当外部寄存器访问控制器对寄存器组中的某一寄存器进行写操作时,数据写入无效,而执行存储器数据到被控制的寄存器的传输,此时,存储器数据通过数据运算模块处理后,再经过寄存器数据开关送到该寄存器,写入该寄存器。数据传输通过预先设置传输控制寄存器为1并通过算法寄存器选择相应的数据处理算法,再通过外部控制访问寄存器对某一寄存器进行读写操作来执行寄存器与存储器之间的数据传输;当对寄存器进行读操作时,执行寄存器到存储器的数据传输。寄存器读出数据经数据开关送到数据运算模块,数据运算模块能包括所有已知的可用数据算法,根据数据算法选择寄存器选择其中一种算法对数据进行处理,经运算后的数据送到存储器数据总线上;当对寄存器进行写操作时,执行存储器到寄存器的数据传输,存储器数据被送到数据运算模块,经选定算法运算后,输出数据通过数据开关送到寄存器数据总线上。写入寄存器。通过对寄存器访问地址、寄存器读写模式、数据传输控制及数据算法选择的不同设置,可以实现任一寄存器数据经任一算法处理后送到存储器,也可实现存储器数据经任一算法处理后写入任一寄存器;寄存器增加时,只要地址空间足够,其它电路也不用作任何变动;数据运算模块增加任何一种算法,该算法即对所有的寄存器及所有的数据传输方向有效。以上通过具体实施方式和实施例对本专利技术进行了详细的说明,但这些并非构成对本专利技术的限制。在不脱离本专利技术原理的情况下,本领域的技术人员还可做出许多变形和改进,这些也应视为本发本文档来自技高网...
【技术保护点】
一种寄存器组与存储器数据双向传输结构,其特征是,包括:外部寄存器访问控制器通过地址总线访问寄存器组,通过控制总线与寄存器组相互通讯;数据总线开关与外部寄存器访问控制器和寄存器组相互通讯;寄存器组具有传输控制寄存器对数据开关进行传输控制;寄存器组具有算法选择寄存器对数据运算模块进行算法控制;算法模块接收存储器输出到寄存器的原始数据经过运算后传送至数据总线开关,接收数据总线开关发送来的寄存器输出到存储器的原始数据经过运算后传送至存储器。
【技术特征摘要】
1.一种寄存器组与存储器数据双向传输结构,其特征是,包括:外部寄存器访问控制器通过地址总线访问寄存器组,通过控制总线与寄存器组相互通讯;数据总线开关与外部寄存器访问控制器和寄存器组相互通讯;寄存器组具有传输控制寄存器对数据总线开关进行传输控制;寄存器组具有算法选择寄存器对数据运算模块进行算法控制;数据运算模块接收存储器输出到寄存器的原始数据经过运算后传送至数据总线开关,接收数据总线开关发送来的寄存器输出到存储器的原始数据经过运算后传送至存储器;传输控制寄存器用于控制寄存器访问模式,当该寄存器及该寄存器的输出信号值为0时,外部寄存器对寄存器组进行正常的读写访问;当该寄存器值为1时,当外部寄存器控制器对寄存器进行读操作时,将执行寄存器到存储器的数据传输;当外部寄存器控制器对寄存器进行写操作时,将执行存储器到寄存器的数据传输。2.一种寄存器组与存储器数据双向传输方法,适用于采用地址数据控制总线访问的寄存器组与存储器,能实现2N-2个寄存器与存储器之间的数据传输,N为寄存...
【专利技术属性】
技术研发人员:雷冬梅,赵锋,
申请(专利权)人:上海华虹宏力半导体制造有限公司,
类型:发明
国别省市:上海;31
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