【技术实现步骤摘要】
【技术保护点】
一种多浮点操作数加/减运算控制器，用于实现多个32位符合IEEE754标准的浮点数加或减运算，其特征在于：该控制器包括命令字及操作数写时序控制模块（Ⅰ）、操作数存储器（Ⅱ）、操作数读时序控制模块（Ⅲ）、运算与输出控制模块（Ⅳ）；所述命令字及操作数写时序控制模块（Ⅰ）与操作数存储器（Ⅱ）、操作数读时序控制模块（Ⅲ）、运算与输出控制模块（Ⅳ）连接；所述操作数存储器（Ⅱ）还与操作数读时序控制模块（Ⅲ）、运算与输出控制模块（Ⅳ）连接；所述操作数读时序控制模块（Ⅲ）还与运算与输出控制模块（Ⅳ）连接；所述命令字及操作数写时序控制模块（Ⅰ）控制完成指令的写入和存储，需要占用系统总线；一条指令包括31位命令字和若干个浮点操作数，浮点操作数最多为26个；所述操作数存储器（Ⅱ）为双端口存储器，一个只写端口，一个只读端口，用于储存命令字及操作数写时序控制模块（Ⅰ）写入的多浮点操作数，以下称为操作数；所述操作数读时序控制模块（Ⅲ）在内部读时序脉冲的控制下，自主完成操作数从操作数存储器（Ⅱ）中的读出，不需要占用系统总线；所述运算与输出控制模块（Ⅳ）根据操作数类型，对参与运算的第1个操作数进行选通控制；所述运算与...
【技术特征摘要】
【专利技术属性】
技术研发人员：蔡启仲，柯宝中，李刚，邱盛成，李克俭，
申请(专利权)人：广西科技大学，
类型：新型
国别省市：广西;45
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